DM74S280N

更新时间： 2024-09-22 22:54:35

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飞兆/仙童 - FAIRCHILD		逻辑集成电路光电二极管
页数	文件大小	规格书
5页	65K
描述
9-Bit Parity Generator/Checker

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DM74S280N 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP, DIP14,.3	针数：	14
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.46	其他特性：	ODD/EVEN PARITY GENERATOR
系列：	S	JESD-30 代码：	R-PDIP-T14
JESD-609代码：	e0	长度：	19.18 mm
逻辑集成电路类型：	PARITY GENERATOR/CHECKER	位数：	9
功能数量：	1	端子数量：	14
最高工作温度：	70 °C	最低工作温度：
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP14,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	5 V
传播延迟（tpd）：	24 ns	认证状态：	Not Qualified
座面最大高度：	5.08 mm	子类别：	Arithmetic Circuits
最大供电电压 (Vsup)：	5.25 V	最小供电电压 (Vsup)：	4.75 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	TTL	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7.62 mm
Base Number Matches：	1

DM74S280N 数据手册

August 1986

Revised May 2000

DM74S280

9-Bit Parity Generator/Checker

General Description

Features

These universal, nine-bit parity generators/checkers utilize

Schottky-clamped TTL high-performance circuitry, and fea-

ture odd/even outputs to facilitate operation of either odd or

even parity applications. The word-length capability is eas-

ily expanded by cascading.

■ Generates either odd or even parity for nine data lines

■ Cascadable for N-bits

■ Can be used to upgrade existing systems using MSI par-

ity circuits

■ Typical data-to-output delay—14 ns

The DM74S280 can be used to upgrade the performance

of most systems utilizing the DM74180 parity generator/

checker. Although the DM74S280 is implemented without

expander inputs, the corresponding function is provided by

the availability of all input at pin 4, and no internal connec-

tion at pin 3. This permits the DM74S280 to be substituted

for the 180 in existing designs to produce an identical func-

tion, even if DM74S280’s are mixed with existing 180’s.

Input buffers are provided so that each input represents

only one normal 74S load, and full fan-out to 10 normal

Series 74S loads is available from each of the outputs at

low logic levels. A fan-out to 20 normal Series 74S loads is

provided at high logic levels, to facilitate connection of

unused inputs to used inputs.

Ordering Code:

Order Number Package Number

Package Description

DM74S280M

DM74S280N

M14A

N14A

14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-120, 0.150 Narrow

14-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.

Connection Diagram

Function Table

Number of Inputs

(A Thru I) that are HIGH

0, 2, 4, 6, 8

Outputs

∑ Even

∑ Odd

1, 3, 5, 7, 9

DS006483

www.fairchildsemi.com

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DM74S280N 替代型号

型号	品牌	替代类型	描述	数据表
SN74S280N3	TI	功能相似	9-BIT ODD/EVEN PARITY GENERATORS/CHECKERS
SNJ54S280J	TI	功能相似	9-BIT ODD/EVEN PARITY GENERATORS/CHECKERS
SN54S280J	TI	功能相似	9-BIT ODD/EVEN PARITY GENERATORS/CHECKERS

与DM74S280N相关器件

型号	品牌	获取价格	描述	数据表
DM74S280N/A+	ETC	获取价格	Parity Generator/Checker
DM74S280N/B+	ETC	获取价格	Parity Generator/Checker
DM74S283	FAIRCHILD	获取价格	4-Bit Binary Adder with Fast Carry
DM74S283J/A+	ETC	获取价格	Binary Adder
DM74S283N	FAIRCHILD	获取价格	4-Bit Binary Adder with Fast Carry
DM74S283N/A+	ETC	获取价格	Binary Adder
DM74S283N/B+	ETC	获取价格	Binary Adder
DM74S287	NSC	获取价格	(256 x 4) 1024-BIT TTL PROM
DM74S287AJ	NSC	获取价格	(256 x 4) 1024-BIT TTL PROM
DM74S287AJ/A+	TI	获取价格	IC,PROM,256X4,TTL,DIP,16PIN,CERAMIC

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