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DM54LS295AW

更新时间： 2024-11-24 14:41:47
品牌 Logo 应用领域
美国国家半导体 - NSC 输出元件逻辑集成电路触发器
页数 文件大小 规格书
6页 128K
描述
IC LS SERIES, 4-BIT RIGHT PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, CDFP14, CERAMIC, FP-14, Shift Register

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DM54LS295AW 技术参数

是否Rohs认证：不符合生命周期：Obsolete
包装说明：CERAMIC, FP-14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.26
Is Samacsys：N计数方向：RIGHT
系列：LSJESD-30 代码：R-GDFP-F14
JESD-609代码：e0长度：9.614 mm
逻辑集成电路类型：PARALLEL IN PARALLEL OUT最大频率@ Nom-Sup：30000000 Hz
位数：4功能数量：1
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DFP封装等效代码：FL14,.3
封装形状：RECTANGULAR封装形式：FLATPACK
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
传播延迟（tpd）：26 ns认证状态：Not Qualified
座面最大高度：2.032 mm子类别：Shift Registers
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：TTL温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：FLAT
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：NEGATIVE EDGE
宽度：6.2865 mm最小 fmax：30 MHz
Base Number Matches：1

DM54LS295AW 数据手册

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April 1992  
DM54LS295A/DM74LS295A  
4-Bit Shift Register with TRI-STATE Outputs  
É
General Description  
Features  
Y
Fully synchronous serial or parallel data transfers  
Negative edge-triggered clock input  
Parallel enable mode control input  
The ’LS295A is a 4-bit shift register with serial and parallel  
synchronous operating modes, and independent TRI-  
STATE output buffers. The Parallel Enable input (PE) con-  
trols the shift-right or parallel load operation. All data trans-  
fers and shifting occur synchronous with the HIGH-to-LOW  
clock transition.  
Y
Y
Y
TRI-STATE bussable output buffers  
The TRI-STATE output buffers are controlled by an active  
HIGH Output Enable input (OE). Disabling the output buffers  
does not affect the shifting or loading of input data, but it  
does inhibit serial expansion. The device is fabricated with  
the Schottky barrier diode process for high speed.  
Connection Diagram  
Logic Symbol  
Dual-In-Line Package  
TL/F/10183–2  
e
e
V
Pin 14  
CC  
GND  
Pin 7  
TL/F/10183–1  
Order Number DM54LS295AJ, DM54LS295AW,  
DM74LS295AM or DM74LS295AN  
See NS Package Number J14A, M14A, N14A or W14B  
Pin Names  
Description  
PE  
Parallel Enable Input (Active HIGH)  
Serial Data Input  
Parallel Data Inputs  
D
S
P0–P3  
OE  
TRI-STATE Output Enable Input (Active HIGH)  
Clock Pulse Input (Active Falling Edge)  
TRI-STATE Outputs  
CP  
O0–O3  
TRI-STATEÉ is a registered trademark of National Semiconductor Corporation.  
C
1995 National Semiconductor Corporation  
TL/F/10183  
RRD-B30M105/Printed in U. S. A.  
123456

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