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CYW312OXC

更新时间： 2024-01-26 18:45:23

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19页	193K
描述
FTG for VIA⑩ K7 Series Chipset with Programmable Output Frequency

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CYW312OXC 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	SSOP	包装说明：	SSOP, SSOP48,.4
针数：	48	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.51	Is Samacsys：	N
其他特性：	ALSO REQUIRES 2.5V SUPPLY	JESD-30 代码：	R-PDSO-G48
JESD-609代码：	e4	长度：	15.875 mm
湿度敏感等级：	3	端子数量：	48
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	200 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装等效代码：	SSOP48,.4
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	2.5/3.3 V
主时钟/晶体标称频率：	14.31818 MHz	认证状态：	Not Qualified
座面最大高度：	2.794 mm	子类别：	Clock Generators
最大供电电压：	3.465 V	最小供电电压：	3.135 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	宽度：	7.5057 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC	Base Number Matches：	1

CYW312OXC 数据手册

W312-02

Pin Definitions (continued)

Type

Pin Name

Pin No.

Pin Description

PD#

Power-Down Input: This input will trigger the clock generator into Power Down

mode when it is active.

SDATA

I/O

Data pin for SMBus circuitry.

Clock pin for SMBus circuitry.

SCLK

VDD_CPU

2.5V Power Connection: Power supply for CPU output buffers. Connect to

2.5V.

VDDQ_AGP

3.3V Power Connection: Power supply for AGP output buffers. Connect to

3.3V.

VDDQ_PCI

15, 23

3.3V Power Connection: Power supply for PCI output buffers. Connect to 3.3V.

VDDQ_48MHz

3.3V Power Connection: Power supply for 48 MHz output buffers. Connect to

3.3V.

VDD_REF

3.3V Power Connection: Power supply for reference output buffers. Connect

to 3.3V.

VDD_Core

3.3V Power Connection: Power supply for PLL core. Connect to 3.3V.

GND_REF,

GND_48MHz,

GND_PCI,

GND_AGP,

GND_Core,

GND_CPU

2, 8, 29, 32, 37,

Ground Connections: Connect all ground pins to the common system ground

plane.

Rev 1.0,November 27, 2006

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