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CYV15G0401DXB-BGI

更新时间： 2024-01-10 17:28:11

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赛普拉斯 - CYPRESS		/
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Quad HOTLink II Transceiver

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CYV15G0401DXB-BGI 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	BGA
包装说明：	HBGA, BGA256,20X20,50	针数：	256
Reach Compliance Code：	compliant	ECCN代码：	5A991.B.1
HTS代码：	8542.39.00.01	风险等级：	5.62
Is Samacsys：	N	数据速率：	1500000 Mbps
JESD-30 代码：	S-PBGA-B256	JESD-609代码：	e1
长度：	27 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	256
收发器数量：	4	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	HBGA	封装等效代码：	BGA256,20X20,50
封装形状：	SQUARE	封装形式：	GRID ARRAY, HEAT SINK/SLUG
峰值回流温度（摄氏度）：	260	电源：	3.3 V
认证状态：	Not Qualified	座面最大高度：	1.745 mm
子类别：	Network Interfaces	最大压摆率：	1.1 mA
标称供电电压：	3.3 V	表面贴装：	YES
技术：	BICMOS	电信集成电路类型：	ETHERNET TRANSCEIVER
温度等级：	COMMERCIAL	端子面层：	Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：	BALL	端子节距：	1.27 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	30
宽度：	27 mm	Base Number Matches：	1

CYV15G0401DXB-BGI 数据手册

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CYP15G0401DXB

CYV15G0401DXB

= Internal Signal

TRSTZ

Receive Path Block Diagram

RXLE

RX PLL Enable

Latch

BOE[7:0]

TMS

TCLK

TDI

Parity Control

JTAG

Boundary

Scan

Character-Rate Clock

SDASEL

Controller

TDO

LPEN

Receive

Signal

INSELA

LFIA

Monitor

INA1+

INA1–

RXDA[7:0]

INA2+

INA2–

Clock &

Data

RXOPA

RXSTA[2:0]

Recovery

PLL

TXLBA

RXCLKA+

RXCLKA–

Clock

÷2

Select

Receive

Signal

INSELB

LFIB

Monitor

INB1+

INB1–

RXDB[7:0]

INB2+

INB2–

Clock &

Data

RXOPB

RXSTB[2:0]

Recovery

PLL

TXLBB

Clock

RXCLKB+

RXCLKB–

÷2

Select

Receive

Signal

INSELC

LFIC

Monitor

INC1+

INC1–

RXDC[7:0]

INC2+

INC2–

Clock &

Data

RXOPC

RXSTC[2:0]

Recovery

PLL

TXLBC

Clock

RXCLKC+

RXCLKC–

÷2

Select

Receive

Signal

LFID

INSELD

Monitor

IND1+

RXDD[7:0]

IND1–

IND2+

IND2–

TXLBD

Clock &

Data

RXOPD

RXSTD[2:0]

Recovery

PLL

RBIST[D:A]

Clock

RXCLKD+

RXCLKD–

÷2

Select

FRAMCHAR

RXRATE

RFEN

BONDST

RFMODE

BOND_ALL

Bonding

Control

RXCKSEL

BOND_INH

MASTER

DECMODE

RXMODE[1:0]

Document #: 38-02002 Rev. *K

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