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CY8C5588AXI-022

更新时间: 2024-02-25 10:20:42
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟
页数 文件大小 规格书
102页 2766K
描述
Multifunction Peripheral, CMOS, PQFP100, 14 X 14 MM, 1.40 MM HEIGHT, ROHS COMPLIANT, MS-026, TQFP-100

CY8C5588AXI-022 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Obsolete零件包装代码:QFP
包装说明:LFQFP, QFP100,.63SQ,20针数:100
Reach Compliance Code:compliantHTS代码:8542.39.00.01
风险等级:5.84地址总线宽度:
边界扫描:YES总线兼容性:USB
最大时钟频率:80 MHz外部数据总线宽度:
JESD-30 代码:S-PQFP-G100JESD-609代码:e4
长度:14 mm湿度敏感等级:3
I/O 线路数量:72端子数量:100
最高工作温度:85 °C最低工作温度:-40 °C
封装主体材料:PLASTIC/EPOXY封装代码:LFQFP
封装等效代码:QFP100,.63SQ,20封装形状:SQUARE
封装形式:FLATPACK, LOW PROFILE, FINE PITCH峰值回流温度(摄氏度):260
电源:1.8/5 V认证状态:Not Qualified
RAM(字数):32768ROM大小(位):262144 Bits
座面最大高度:1.6 mm子类别:Other Microprocessor ICs
最大供电电压:5.5 V最小供电电压:1.71 V
标称供电电压:1.8 V表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:Nickel/Palladium/Gold (Ni/Pd/Au)端子形式:GULL WING
端子节距:0.5 mm端子位置:QUAD
处于峰值回流温度下的最长时间:20紫外线可擦:N
宽度:14 mmBase Number Matches:1

CY8C5588AXI-022 数据手册

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PRELIMINARY  
PSoC® 5: CY8C55 Family Datasheet  
Figure 2-4. Example Schematic for 100-pin TQFP Part with Power Connections  
Vddd  
Vddd  
C1  
1 uF  
C2  
0.1 uF  
Vddd  
Vccd  
C6  
0.1 uF  
Vssd  
Vssd  
U2  
Vssd  
CY8C55xx  
Vdda  
Vddd  
75  
74  
73  
72  
71  
70  
69  
68  
67  
66  
65  
64  
63  
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60  
59  
58  
57  
56  
55  
54  
53  
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51  
1
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3
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5
6
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8
9
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18  
19  
20  
21  
22  
23  
24  
25  
P2[5]  
P2[6]  
P2[7]  
P12[4], SIO  
P12[5], SIO  
P6[4]  
P6[5]  
P6[6]  
P6[7]  
Vssb  
Ind  
Vboost  
Vbat  
Vssd  
XRES  
P5[0]  
P5[1]  
P5[2]  
P5[3]  
P1[0], SWIO, TMS  
P1[1], SWDIO, TCK  
P1[2]  
P1[3], SWV, TDO  
P1[4], TDI  
P1[5], nTRST  
Vddio0  
OA0-, REF0, P0[3]  
C8  
0.1 uF  
C17  
1 uF  
OA0+, P0[2]  
OA0out, P0[1]  
OA2out, P0[0]  
P4[1]  
Vssd  
P4[0]  
Vssa  
Vdda  
SIO, P12[3]  
SIO, P12[2]  
Vssd  
Vssd  
Vssd  
Vdda  
Vssa  
Vcca  
Vdda  
Vssa  
Vcca  
NC  
NC  
NC  
NC  
NC  
Vssd  
Vssd  
C9  
1 uF  
C10  
0.1 uF  
NC  
Vssa  
kHzXin, P15[3]  
kHzXout, P15[2]  
SIO, P12[1]  
SIO, P12[0]  
OA3out, P3[7]  
OA1out, P3[6]  
Vddd  
Vddd  
C11  
0.1 uF  
C12  
0.1 uF  
C13  
10 uF, 6.3 V 0.1 uF Vssd  
C14  
C15  
1 uF  
Vssd  
C16  
0.1 uF  
Vssa  
Vssa  
Vssd  
Note The two VCCD pins must be connected together with as short a trace as possible. A trace under the device is recommended, as  
shown in Figure 2-5.  
Figure 2-5. Example PCB Layout for 100-pin TQFP Part for Optimal Analog Performance  
Vssa  
Vssd  
Vdda  
Vddd  
Vssa  
Plane  
Vssd  
Plane  
Document Number: 001-44094 Rev. *J  
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