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Datasheet > 微控制器和处理器 > 其他 uPs/uCs/外围集成电路> CY8C5246AXI-054T
CY8C5246AXI-054T PDF预览

CY8C5246AXI-054T

更新时间： 2024-01-30 22:29:12
品牌 Logo 应用领域
赛普拉斯 - CYPRESS /
页数 文件大小 规格书
85页 2770K
描述
Micro Peripheral IC, CMOS, PQFP100

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CY8C5246AXI-054T 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：QFP, QFP100,.63SQ,20Reach Compliance Code：unknown
风险等级：5.81JESD-30 代码：S-PQFP-G100
端子数量：100最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：QFP封装等效代码：QFP100,.63SQ,20
封装形状：SQUARE封装形式：FLATPACK
电源：3/5 V认证状态：Not Qualified
ROM大小（位）：524288 Bits子类别：Other Microprocessor ICs
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
紫外线可擦：NBase Number Matches：1

CY8C5246AXI-054T 数据手册

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PRELIMINARY  
PSoC®5:CY8C52FamilyData Sheet  
1. Architectural Overview  
Introducing the CY8C52 family of ultra low power, Flash Programmable System-on-Chip (PSoC®) devices, part of a scalable 8-bit  
PSoC®3 and 32-bit PSoC 5 platform. The CY8C52 family provides configurable blocks of analog, digital, and interconnect circuitry  
around a CPU subsystem. The combination of a CPU with a very flexible analog subsystem, digital subsystem, routing, and I/O  
enables a high level of integration in a wide variety of consumer, industrial, and medical applications.  
Figure 1-1. Simplified Block Diagram  
Analog Interconnect  
Digital Interconnect  
SYSTEM WIDE  
RESOURCES  
DIGITAL SYSTEM  
I2C  
Master/  
Slave  
Universal Digital Block Array(24 x UDB)  
CAN  
2.0  
8- Bit  
Timer  
Quadrature Decoder  
16- Bit PRS  
4- 33 MHz  
( Optional)  
16- Bit  
PWM  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
UDB  
Xtal  
Osc  
D+  
D-  
USB  
PHY  
UDB  
8- Bit  
FS USB  
2.0  
UDB  
UDB  
UDB  
I 2C Slave  
UDB  
4x  
Timer  
8- Bit SPI  
Logic  
Timer  
Counter  
PWM  
12- Bit SPI  
UDB  
UDB  
UDB  
UDB  
UDB  
IMO  
Logic  
32.768 KHz  
( Optiona)l  
UDB  
UDB  
UART  
12- Bit PWM  
RTC  
Timer  
SYSTEM BUS  
Program&  
Debug  
MEMORY SYSTEM  
CPU SYSTEM  
WDT  
and  
Wake  
8051or  
Interrupt  
EEPROM  
SRAM  
Program  
Cortex M3 CPU  
Controller  
Debug&  
Trace  
Cache  
Controller  
PHUB  
DMA  
FLASH  
EMIF  
Boundary  
Scan  
ILO  
Clocking System  
ANALOG SYSTEM  
ADC  
Power Management  
System  
LCD Direct  
Drive  
POR and  
LVD  
-
SAR  
ADC  
Sleep  
Power  
+
Temperature  
Sensor  
4 x  
CMP  
1.8V LDO  
SMP  
-
CapSense  
0. 5 to5.5V  
( Optional)  
Document Number: 001-55034 Rev. *A  
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型号 品牌 获取价格 描述 数据表
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