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CY7C65620-56LTXA PDF预览

CY7C65620-56LTXA

更新时间： 2024-11-24 20:08:27
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 外围集成电路
页数 文件大小 规格书
32页 437K
描述
USB Bus Controller, CMOS, QFN-56

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CY7C65620-56LTXA 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete包装说明：QFN-56
Reach Compliance Code：compliantHTS代码：8542.31.00.01
风险等级：8.03地址总线宽度：
总线兼容性：SPI; VBUS外部数据总线宽度：
JESD-30 代码：S-XQCC-N56JESD-609代码：e3
长度：8 mm湿度敏感等级：3
端子数量：56最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
座面最大高度：1 mm最大供电电压：3.45 V
最小供电电压：3.15 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：8 mmuPs/uCs/外围集成电路类型：BUS CONTROLLER, UNIVERSAL SERIAL BUS
Base Number Matches：1

CY7C65620-56LTXA 数据手册

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CY7C65620  
CY7C65630  
EZ-USB HX2LP™  
Low Power USB 2.0 Hub Controller Family  
EZ-USB HX2LP™ Low Power USB 2.0 Hub Controller Family  
■ Integrated upstream and downstream termination resistors  
■ Integrated port status indicator control  
Features  
■ USB 2.0 hub controller  
■ 24 MHz external crystal (integrated phase-locked loop (PLL))  
■ Automotive and Industrial grade option (–40 °C to 85 °C)  
■ Compliant with USB 2.0 specification  
■ USB-IF certified: TID# 30000009  
■ In-system EEPROM programming  
■ Configurable with external SPI EEPROM:  
❐ Vendor ID, Product ID, Device ID (VID/PID/DID)  
❐ Number of active ports  
❐ Number of removable ports  
❐ Maximum power setting for high-speed and full-speed  
❐ Hub controller power setting  
❐ Power-on timer  
■ Windows Hardware Quality Lab (WHQL) Compliant  
■ Up to four downstream ports supported  
■ Supports bus powered and self powered modes  
■ Single transaction translator (TT)  
❐ Overcurrent detection mode  
❐ Enabled and disabled overcurrent timer  
❐ Overcurrent pin polarity  
■ Bus power configurations  
■ Fit, form, and function compatible with CY7C65640 and  
CY7C65640A (TetraHub™)  
❐ Indicator pin polarity  
❐ Compound device  
❐ Enable full-speed only  
■ Space saving 56-pin QFN  
■ Single power supply requirement  
❐ Internal regulator for reduced cost  
❐ Disable port indicators  
❐ Ganged power switching  
❐ Self and bus powered compatibility  
❐ Fully configurable string descriptors for multiple language  
support  
■ Integrated upstream pull-up resistor  
■ Integrated pull-down resistors for all downstream ports  
For a complete list of related documentation, click here.  
Block Diagram –  
CY7C65630  
D+  
D -  
High-Speed  
USB Control Logic  
USB 2.0 PHY  
PLL  
Serial  
Interface  
Engine  
24 MHz  
Crystal  
SPI_SCK  
SPI_SD  
SPI_CS  
SPI Communication  
Block  
USB Upstream Port  
Transaction Translator  
TT RAM  
Hub Repeater  
Routing Logic  
USB Downstream Port 1  
USB Downstream Port 2  
USB Downstream Port 3  
USB Downstream Port 4  
USB 2.0  
PHY  
Port  
Status  
Port Power  
Control  
USB 2.0 Port Power  
PHY  
Control  
Port  
Status  
USB 2.0 Port Power  
PHY  
Control  
Port  
Status  
USB 2.0 Port Power  
PHY  
Control  
Port  
Status  
D+ D- PWR#[4]  
LED  
D+ D- PWR#[3]  
OVR#[3]  
LED  
D+ D- PWR#[1]  
OVR#[1]  
LED D+ D- PWR#[2]  
LED  
OVR#[2]  
OVR#[4]  
Errata: For information on silicon errata, see “Errata” on page 28. Details include trigger conditions, devices affected, and proposed workaround.  
Cypress Semiconductor Corporation  
Document Number: 38-08037 Rev. AE  
•
198 Champion Court  
•
San Jose, CA 95134-1709  
•
408-943-2600  
Revised June 8, 2017  
1234567...32

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CY7C65620-56LTXA 替代型号

型号 品牌 替代类型 描述 数据表
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