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CY7C1510AV18

更新时间： 2022-04-23 23:00:11

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赛普拉斯 - CYPRESS		静态存储器
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描述
72-Mbit QDR-II⑩ SRAM 2-Word Burst Architecture

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CY7C1510AV18 数据手册

CY7C1510AV18

CY7C1525AV18

CY7C1512AV18

CY7C1514AV18

PRELIMINARY

Logic Block Diagram (CY7C1512AV18)

[17:0]

Write

Reg

Write

Reg

Address

(20:0)

Address

(20:0)

RPS

Control

Logic

CLK

Gen.

DOFF

Read Data Reg.

REF

Reg.

WPS

BWS

Control

Logic

[1:0]

[17:0]

Logic Block Diagram (CY7C1514AV18)

[35:0]

Write

Reg

Write

Reg

Address

(19:0)

Address

(19:0)

RPS

Control

Logic

CLK

Gen.

DOFF

Read Data Reg.

REF

Reg.

WPS

BWS

Control

Logic

[3:0]

[35:0]

Selection Guide

250 MHz

200 MHz

167 MHz

167

Unit

MHz

Maximum Operating Frequency

Maximum Operating Current

250

950

200

850

800

Document #: 001-06984 Rev. *B

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