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CY7C1338F-100AI PDF预览

CY7C1338F-100AI

更新时间： 2024-11-22 22:13:43
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 存储内存集成电路静态存储器时钟
页数 文件大小 规格书
17页 405K
描述
4-Mb (128K x 32) Flow-Through Sync SRAM

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CY7C1338F-100AI 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：14 X 20 MM, 1.40 MM HEIGHT, PLASTIC, TQFP-100
针数：100Reach Compliance Code：compliant
ECCN代码：3A991.B.2.AHTS代码：8542.32.00.41
风险等级：5.85最长访问时间：8 ns
其他特性：FLOW-THROUGH ARCHITECTURE最大时钟频率 (fCLK)：100 MHz
I/O 类型：COMMONJESD-30 代码：R-PQFP-G100
JESD-609代码：e0长度：20 mm
内存密度：4194304 bit内存集成电路类型：CACHE SRAM
内存宽度：32湿度敏感等级：3
功能数量：1端子数量：100
字数：131072 words字数代码：128000
工作模式：SYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：128KX32
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：LQFP封装等效代码：QFP100,.63X.87
封装形状：RECTANGULAR封装形式：FLATPACK, LOW PROFILE
并行/串行：PARALLEL峰值回流温度（摄氏度）：225
电源：2.5/3.3,3.3 V认证状态：Not Qualified
座面最大高度：1.6 mm最大待机电流：0.04 A
最小待机电流：3.14 V子类别：SRAMs
最大压摆率：0.205 mA最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：TIN LEAD (800)
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：14 mmBase Number Matches：1

CY7C1338F-100AI 数据手册

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CY7C1338F  
4-Mb (128K x 32) Flow-Through Sync SRAM  
6.5 ns (133-MHz version). A 2-bit on-chip counter captures the  
first address in a burst and increments the address automati-  
cally for the rest of the burst access. All synchronous inputs  
Features  
• 128K X 32 common I/O  
• 3.3V –5% and +10% core power supply (VDD  
are gated by registers controlled by a positive-edge-triggered  
Clock Input (CLK). The synchronous inputs include all  
addresses, all data inputs, address-pipelining Chip Enable  
)
• 2.5V or 3.3V I/O supply (VDDQ  
• Fast clock-to-output times  
— 6.5 ns (133-MHz version)  
— 7.5 ns (117-MHz version)  
— 8.0 ns (100-MHz version)  
— 11.0 ns (66-MHz version)  
)
(
), depth-expansion Chip Enables (CE and  
), Burst  
CE3  
CE1  
2
Control inputs (  
,
,
), Write Enables  
). Asynchronous  
and  
ADV  
ADSC ADSP  
(
,
and  
), and Global Write (  
BW[A:D]  
BWE  
GW  
(
)
and the ZZ pin  
.
nputs include the Output Enable  
OE  
i
The CY7C1338F allows either interleaved or linear burst  
sequences, selected by the MODE input pin. A HIGH selects  
an interleaved burst sequence, while a LOW selects a linear  
burst sequence. Burst accesses can be initiated with the  
Processor Address Strobe (ADSP) or the cache Controller  
Address Strobe (ADSC) inputs. Address advancement is  
controlled by the Address Advancement (ADV) input.  
• Provide high-performance 2-1-1-1 access rate  
• User-selectable burst counter supporting Intel  
Pentiuminterleaved or linear burst sequences  
• Separate processor and controller address strobes  
• Synchronous self-timed write  
Addresses and chip enables are registered at rising edge of  
• Asynchronous output enable  
clock when either Address Strobe Processor (  
) or  
ADSP  
• Offered in JEDEC-standard 100-pin TQFP and 119-ball  
Address Strobe Controller (  
) are active. Subsequent  
ADSC  
BGA packages  
burst addresses can be internally generated as controlled by  
the Advance pin ( ).  
• “ZZ” Sleep Mode option  
ADV  
Functional Description[1]  
The CY7C1338F is a 131,072 x 32 synchronous cache RAM  
designed to interface with high-speed microprocessors with  
minimum glue logic. Maximum access delay from clock rise is  
The CY7C1338F operates from a +3.3V core power supply  
while all outputs may operate with either a +2.5 or +3.3V  
supply. All inputs and outputs are JEDEC-standard  
JESD8-5-compatible.  
Logic Block Diagram  
ADDRESS  
REGISTER  
A0, A1, A  
A[1:0]  
MODE  
ADV  
CLK  
Q1  
BURST  
COUNTER  
AND LOGIC  
Q0  
CLR  
ADSC  
ADSP  
DQ  
D BYTE  
DQ  
D BYTE  
WRITE REGISTER  
BW  
D
WRITE REGISTER  
DQ  
C BYTE  
DQ  
C BYTE  
WRITE REGISTER  
BW  
C
WRITE REGISTER  
OUTPUT  
BUFFERS  
MEMORY  
ARRAY  
SENSE  
AMPS  
DQs  
DQ  
B BYTE  
DQ  
B BYTE  
WRITE REGISTER  
BW  
B
WRITE REGISTER  
DQ  
A BYTE  
WRITE REGISTER  
DQA BYTE  
BW  
A
WRITE REGISTER  
BWE  
INPUT  
REGISTERS  
GW  
ENABLE  
REGISTER  
CE1  
CE2  
CE3  
OE  
SLEEP  
CONTROL  
ZZ  
Note:  
1. For best–practices recommendations, please refer to the Cypress application note System Design Guidelines on www.cypress.com.  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose, CA 95134  
•
408-943-2600  
Document #: 38-05218 Rev. *A  
Revised February 2, 2004  
1234567...17

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型号 品牌 获取价格 描述 数据表
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