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CY251XXZC-W

更新时间： 2024-09-30 20:06:03

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赛普拉斯 - CYPRESS		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
11页	127K
描述
Clock Generator, 200MHz, CMOS, PDSO8, 4.40 MM, TSSOP-8

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CY251XXZC-W 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	TSSOP,	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.91
JESD-30 代码：	R-PDSO-G8	JESD-609代码：	e0
长度：	4.4 mm	端子数量：	8
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	200 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	240
主时钟/晶体标称频率：	166 MHz	认证状态：	Not Qualified
座面最大高度：	1.1 mm	最大供电电压：	3.45 V
最小供电电压：	3.13 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	TIN LEAD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	3 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

CY251XXZC-W 数据手册

CY25100

Field- and Factory-Programmable Spread Spectrum

Clock Generator for EMI Reduction

Benefits

Features

• Wide operating output (SSCLK) frequency range

— 3–200 MHz

• Services most PC peripherals, networking, and consumer

applications.

• Provides wide range of spread percentages for maximum

electromagnetic interference (EMI) reduction, to meet

regulatory agency electromagnetic compliance (EMC)

requirements. Reduces development and manufacturing

costs and time-to-market.

• Eliminates the need for expensive and difficult to use

higher-order crystals.

• Internal PLL to generate up to 200-MHz output. Able to

generate custom frequencies from an external crystal or a

driven source.

• In-house programming of samples and prototype quantities

is available using the CY3672 programming kit and

CY3690(TSSOP) or CY3691(SOIC) socket adapter.

Production quantities are available through Cypress’s

value-added distribution partners or by using third party

programmers from BP Microsystems, HiLo Systems, and

others.

• Programmable spread spectrum with nominal 31.5-kHz

modulation frequency

— Center spread: ±0.25% to ±2.5%

— Down spread: –0.5% to –5.0%

• Input frequency range

— External crystal: 8–30 MHz fundamental crystals

— External reference: 8–166 MHz Clock

• Integrated phase-locked loop (PLL)

• Field-programmable

— CY25100SCF, 8-pin SOIC

— CY25100ZCF, 8-pin TSSOP

• Programmable crystal load capacitor tuning array

• Low cycle-to-cycle Jitter

• 3.3V operation

• Spread Spectrum On/Off function

• Power-down or Output Enable function

• Enables fine-tuning of output clock frequency by adjusting

_Loadof the crystal. Eliminates the need for external C_Load

capacitors.

• Suitable for most PC, consumer, and networking applica-

tions

• Application compatibility in standard and low-power

systems.

• Provides ability to enable or disable spread spectrum with

an external pin.

• Enables low-power state or output clocks to High-Z state.

Pin Configuration

Logic Block Diagram

CY25100

8-pin SOIC/TSSOP

RFB

PLL

with

MODULATION

CONTROL

VDD

SSON#

SSCLK

XIN

CXIN

XOUT

OUTPUT

DIVIDERS

and

PROGRAMMABLE

CONFIGURATION

REFCLK

XOUT

XIN/CLKIN

PD#/OE

REFCLK 6

VSS 5

MUX

C^XOUT

SSCLK

PD# or OE

SSON#

VDD

VSS

Cypress Semiconductor Corporation

Document #: 38-07499 Rev. *B

•

3901 North First Street

•

San Jose, CA 95134

•

408-943-2600

Revised October 15, 2003

12 3 4 5 6 7...11

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