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CS9370DGP

更新时间： 2024-10-29 00:04:23

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CS9370DGP 数据手册

概述

CS9370DGP 是一个完整的 DTMF 接收解码电路。和其它电路，如 LCD 驱动电路一起，可实现

CALLER ID 功能。它集成了陷波滤波器和数字解码功能。在滤波器部分，使用了开关电容技术；解

码部分，用数字计数的方法检测所有 16 种 DTMF 音频对，并将它们编成 4bits 的码。通过在芯片上

放置差分输入放大器，时钟晶振和可锁存的三态输出，可以使外围元件最少。

功能特点

管脚排列图

IN+ 1

18 VDD

17 St/GT

16 ESt

15 StD

14 Q4

●

单 5V工作电压

IN- 2

GS 3

● CMOS工艺

●

性能优越，最小外围线路设计

VREF 4

INH 5

低功耗设计

省电模式

PWDN 6

OSC1 7

OSC2 8

VSS 9

13 Q3

12 Q2

● INHIBIT模式

封装形式：DIP18 塑封

11 Q1

10 TOE

●

管脚说明

序号

符号

IN+

I/O

端口形式

功

能

放大器同相输入端。

IN-

放大器反相输入端。

放大器输出，增益选择

VREE

INH

参考电压输出，通常为 VDD/2。

CMOS IN 下拉 1633Hz 检测控制端，高电平有效。

CMOS IN 下拉省电模式控制端，高电平时，振荡器停振。

PWDN

OSC1

OSC2

VSS

振荡器入端

振荡器出端

电源负端。

外接 3.579545MHz 的晶振或陶瓷振

荡器。

TOE

CMOS IN 上拉数据输出控制端，高电平时允许 Q1～Q4 输出。

解码后的三态数据输出端，TOE 端为“高”，输出数据；

TOE 为“低”，高阻抗。

11～14 Q1～Q4

延迟的保持时间端，当接受到一个有效 DTMF 信号，

STD 变“高”，否则为“低”。

StD

Est

CMOS OUT

先前保持时间端，当检测到一个被承认的音频对时为高

电平，否则为低。

CMOS OUT

St/GT

VDD

I/O

CMOS I/O

通过外接电阻电容来选择 DTMF 有效时间及解除时间。

电源正端。

版本：1.1 2001-04-25

第 1 页共 7 页

12 3 4 5 6 7

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