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CDC586PAHRG4 PDF预览

CDC586PAHRG4

更新时间： 2024-11-17 14:49:47
品牌 Logo 应用领域
德州仪器 - TI 驱动信息通信管理逻辑集成电路
页数 文件大小 规格书
14页 304K
描述
3.3V PLL Clock Driver with 1/2x, 1x and 2x Frequency Options 52-TQFP

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CDC586PAHRG4 技术参数

是否无铅：含铅是否Rohs认证：符合
生命周期：Obsolete零件包装代码：QFP
包装说明：TQFP, TQFP52,.47SQ,25针数：52
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.81Is Samacsys：N
系列：586输入调节：STANDARD
JESD-30 代码：S-PQFP-G52JESD-609代码：e4
长度：10 mm逻辑集成电路类型：PLL BASED CLOCK DRIVER
最大I（ol）：0.032 A湿度敏感等级：4
功能数量：1反相输出次数：
端子数量：52实输出次数：12
最高工作温度：70 °C最低工作温度：
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：TQFP封装等效代码：TQFP52,.47SQ,25
封装形状：SQUARE封装形式：FLATPACK, THIN PROFILE
峰值回流温度（摄氏度）：260电源：3.3 V
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.5 ns
座面最大高度：1.2 mm子类别：Clock Drivers
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：BICMOS温度等级：COMMERCIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.65 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：10 mm
最小 fmax：100 MHzBase Number Matches：1

CDC586PAHRG4 数据手册

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CDC586  
www.ti.com  
SCAS336E–FEBRUARY 1993–REVISED APRIL 2004  
3.3-V PHASE-LOCK-LOOP CLOCK DRIVER WITH 3-STATE OUTPUTS  
FEATURES  
•
Application for Synchronous DRAM,  
High-Speed Microprocessor  
•
Low Output Skew for Clock-Distribution  
and Clock-Generation Applications  
•
•
TTL-Compatible Inputs and Outputs  
•
•
Operates at 3.3-V VCC  
Outputs Drive Parallel 50-Ω Terminated  
Transmission Lines  
Distributes One Clock Input to 12  
Outputs  
•
•
•
State-of-the-Art EPIC-IIB™ BiCMOS Design  
Significantly Reduces Power Dissipation  
•
Two Select Inputs Configure Up to Nine  
Outputs to Operate at One-Half or Double  
the Input Frequency  
Distributed VCC and Ground Pins Reduce  
Switching Noise  
•
•
No External RC Network Required  
Packaged in 52-Pin Thin Quad Flat Package  
External Feedback Pin (FBIN) Is Used to  
Synchronize the Outputs to the Clock Input  
PAH PACKAGE  
(TOP VIEW)  
52 51 50 49 48 47 46 45 44 43 42 41 40  
39  
GND  
1Y1  
V
4Y3  
1
CC  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
2
V
CC  
GND  
3
GND  
1Y2  
V
CC  
4
4Y2  
GND  
5
V
CC  
6
GND  
1Y3  
V
CC  
7
4Y1  
GND  
GND  
8
V
CC  
9
GND  
GND  
2Y1  
10  
11  
12  
13  
V
CC  
3Y3  
GND  
V
CC  
14 15 16 17 18 19 20 21 22 23 24 25 26  
NC – No internal connection  
DESCRIPTION  
The CDC586 is a high-performance, low-skew, low-jitter clock driver. It uses a phase-lock loop (PLL) to precisely  
align, in both frequency and phase, the clock output signals to the clock input (CLKIN) signal. It is specifically  
designed for use with popular microprocessors operating at speeds from 50 MHz to 100 MHz or down to 25 MHz  
on outputs configured as half-frequency outputs. The CDC586 operates at 3.3-V VCC and is designed to drive a  
properly terminated 50-W transmission line.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
EPIC-IIB is a trademark of Texas Instruments.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 1993–2004, Texas Instruments Incorporated  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
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CDC586PAHRG4 替代型号

型号 品牌 替代类型 描述 数据表
CDC586PAHR TI

完全替代

 3.3V PLL Clock Driver with 1/2x, 1x and 2x Frequency Options 52-TQFP
CDC586PAH TI

类似代替

 3.3-V PHASE-LOCK-LOOP CLOCK DRIVER WITH 3-STATE OUTPUTS

与CDC586PAHRG4相关器件

型号 品牌 获取价格 描述 数据表
CDC586PBG ETC

获取价格

 		Twelve Distributed-Output Clock Driver
CDC587DGGR TI

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 		CDC SERIES, PLL BASED CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO56
CDC5D20 SUMIDA

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 		CDC5D20
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