Datasheet > 信号电路 > 锁相环或频率合成电路> CD4046BCMX

CD4046BCMX

更新时间： 2024-01-19 04:59:12

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飞兆/仙童 - FAIRCHILD		/
页数	文件大小	规格书
14页	175K
描述
Analog Phase-Locked Loop

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CD4046BCMX 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TSSOP
包装说明：	TSSOP-16	针数：	16
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	Factory Lead Time：	1 week
风险等级：	1.23	Is Samacsys：	N
模拟集成电路 - 其他类型：	PHASE LOCKED LOOP	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e4	长度：	5 mm
湿度敏感等级：	1	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP16,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	5/15 V
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	PLL or Frequency Synthesis Circuits	最大供电电压 (Vsup)：	18 V
最小供电电压 (Vsup)：	5 V	标称供电电压 (Vsup)：	10 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	4.4 mm	Base Number Matches：	1

CD4046BCMX 数据手册

Typical f_MAX/f_MINvs R2/R1

FIGURE 7.

Typical VCO Power Dissipation

at Center Frequency vs R1

FIGURE 8.

Note: To obtain approximate total power dissipation of PLL system for no-signal input: Phase Comparator I, P (Total) = P (f ) + P (f ) + P (R ); Phase

MIN

Comparator II, P (Total) = P (f

MIN

www.fairchildsemi.com

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与CD4046BCMX相关器件

型号	品牌	获取价格	描述	数据表
CD4046BCN	FAIRCHILD	获取价格	Micropower Phase-Locked Loop
CD4046BCN/A+	ETC	获取价格	Analog Phase-Locked Loop
CD4046BCN/B+	ETC	获取价格	Analog Phase-Locked Loop
CD4046BCNX	FAIRCHILD	获取价格	Micropower Phase-Locked Loop
CD4046BCWM/A+	ETC	获取价格	Analog Phase-Locked Loop
CD4046BD	RENESAS	获取价格	IC,PHASE-LOCKED LOOP,CMOS,DIP,16PIN,CERAMIC
CD4046BD	ROCHESTER	获取价格	Phase Locked Loop, CMOS, CDIP16, CERAMIC, METAL SEAL, DIP-16
CD4046BD3	ROCHESTER	获取价格	Phase Locked Loop, CMOS, CDIP16, CERAMIC, METAL SEAL, DIP-16
CD4046BD3	RENESAS	获取价格	IC,PHASE-LOCKED LOOP,CMOS,DIP,16PIN,CERAMIC
CD4046BDMS	RENESAS	获取价格	PHASE LOCKED LOOP, CDIP16, SIDE BRAZED, CERAMIC, DIP-16