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CD4013BFMSR

更新时间： 2024-01-07 14:55:35

品牌	Logo	应用领域
瑞萨 - RENESAS		输出元件逻辑集成电路触发器
页数	文件大小	规格书
9页	76K
描述
4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDIP14

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CD4013BFMSR 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	DIP, DIP14,.3	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.66
其他特性：	RADIATION HARDENED; INPUT AC PARAMETRIC VALUES NOT FROM POST RADIATION MEASUREMENT	系列：	4000/14000/40000
JESD-30 代码：	R-GDIP-T14	JESD-609代码：	e0
负载电容（CL）：	50 pF	逻辑集成电路类型：	D FLIP-FLOP
最大频率@ Nom-Sup：	3500000 Hz	最大I（ol）：	0.00036 A
位数：	1	功能数量：	2
端子数量：	14	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出极性：	COMPLEMENTARY
封装主体材料：	CERAMIC, GLASS-SEALED	封装代码：	DIP
封装等效代码：	DIP14,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	5/15 V	Prop。Delay @ Nom-Sup：	405 ns
传播延迟（tpd）：	405 ns	认证状态：	Not Qualified
筛选级别：	38535V;38534K;883S	子类别：	FF/Latches
最大供电电压 (Vsup)：	18 V	最小供电电压 (Vsup)：	3 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	总剂量：	100k Rad(Si) V
触发器类型：	POSITIVE EDGE	最小 fmax：	2.59 MHz

CD4013BFMSR 数据手册

CD4013BMS

CMOS Dual ‘D’-Type Flip-Flop

December 1992

Features

Pinout

• High-Voltage Type (20V Rating)

• Set-Reset Capability

14 VDD

13 Q2

• Static Flip-Flop Operation - Retains State Indeﬁnitely

With Clock Level Either “High” Or “Low”

CLOCK 1

RESET 1

12 Q2

11 CLOCK 2

10 RESET 2

• Medium-Speed Operation - 16 MHz (typ.) Clock Toggle

Rate at 10V

SET 1

VSS

• Standardized Symmetrical Output Characteristics

• 100% Tested for Quiescent Current at 20V

SET 2

• Maximum Input Current of 1µA at 18V Over Full Pack-

age Temperature Range; 100nA at 18V and +25^oC

• Noise Margin (Over Full Package Temperature Range):

- 1V at VDD = 5V

Functional Diagram

VDD

- 2V at VDD = 10V

- 2.5V at VDD = 15V

• 5V, 10V and 15V Parametric Ratings

SET 1

• Meets All Requirements of JEDEC Tentative Standard

No. 13B, “Standard Speciﬁcations for Description of

‘B’ Series CMOS Devices”

F/F1

F/F2

CLOCK 1

Applications

• Registers

RESET 1

SET 2

• Counters

• Control Circuits

CLOCK 2

Description

RESET 2

CD4013BMS consists of two identical, independent data

type ﬂip-ﬂops. Each ﬂip-ﬂop has independent data, set,

reset, and clock inputs and Q and Q outputs. These devices

can be used for shift register applications, and, by

connecting Q output to the data input, for counter and toggle

applications. The logic level present at the D input is

transferred to the Q output during the positive going

transition of the clock pulse. Setting or resetting is

independent of the clock and is accomplished by a high level

on the set or reset line, respectively.

VSS

The CD4013BMS is supplied in these 14 lead outline pack-

ages:

Braze Seal DIP

Frit Seal DIP

H4Q

H1B

Ceramic Flatpack H3W

CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.

File Number 3080

7-62

12 3 4 5 6 7...9

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与CD4013BFMSR相关器件

型号	品牌	获取价格	描述	数据表
CD4013BFX	ROCHESTER	获取价格	4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, C
CD4013BK	RENESAS	获取价格	IC,FLIP-FLOP,DUAL,D TYPE,CMOS,FP,14PIN,CERAMIC
CD4013BK3	RENESAS	获取价格	IC,FLIP-FLOP,DUAL,D TYPE,CMOS,FP,14PIN,CERAMIC
CD4013BK3	TI	获取价格	CMOS DUAL D-TYPE FLIP-FLOP
CD4013BKMS	RENESAS	获取价格	4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, C
CD4013BKMSH	RENESAS	获取价格	D Flip-Flop, 4000/14000/40000 Series, 2-Func, Positive Edge Triggered, 1-Bit, Complementar
CD4013BKMSR	ETC	获取价格	Dual D-Type Flip-Flop
CD4013BM	NSC	获取价格	Dual D Flip-Flop
CD4013BM	TI	获取价格	CMOS DUAL D-TYPE FLIP-FLOP
CD4013BM96	TI	获取价格	CMOS DUAL D-TYPE FLIP-FLOP

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