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BU9882FV-WE2

更新时间： 2024-02-28 19:39:11
品牌 Logo 应用领域
罗姆 - ROHM 存储内存集成电路光电二极管可编程只读存储器电动程控只读存储器电可擦编程只读存储器时钟
页数 文件大小 规格书
23页 647K
描述
EDID Memory (For display)

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BU9882FV-WE2 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SSOP
包装说明：ROHS COMPLIANT, SSOP-14针数：14
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.32.00.51风险等级：1.45
Is Samacsys：N最大时钟频率 (fCLK)：0.4 MHz
JESD-30 代码：R-PDSO-G14长度：5 mm
内存密度：2048 bit内存集成电路类型：EEPROM
内存宽度：8功能数量：1
端口数量：2端子数量：14
字数：256 words字数代码：256
工作模式：SYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：256X8
封装主体材料：PLASTIC/EPOXY封装代码：LSSOP
封装等效代码：TSSOP14,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, LOW PROFILE, SHRINK PITCH并行/串行：SERIAL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3/5 V
认证状态：Not Qualified座面最大高度：1.25 mm
串行总线类型：I2C最大待机电流：0.000005 A
子类别：EEPROMs最大压摆率：0.003 mA
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2.5 V
标称供电电压 (Vsup)：4 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mm最长写入周期时间 (tWC)：10 ms
Base Number Matches：1

BU9882FV-WE2 数据手册

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BR24C21,BR24C21F,BR24C21FJ,BR24C21FV,  
BU9882-W,BU9882F-W,BU9882FV-W  
Technical Note  
●Bidirectional mode command  
○Byte Write  
When the Master generates a STOP condition, the BR24C21/F/FJ/FV begins the internal write cycle to the nonvolatile array.  
S
T
A
R
T
W
R
I
T
E
S
T
O
P
SLAVE  
ADDRESS  
WORD  
ADDRESS  
DATA  
SDA  
LINE  
WA  
0
WA  
6
1
0
1
0
*
*
*
*
D7  
D0  
R
/
W
A
C
K
A
C
K
A
C
K
VCLK  
*:Don’t care  
Fig.10 Byte Write Cycle Timing  
○Page Write  
If the Master transmits the next data instead of generating a STOP condition during the byte write cycle, the  
BR24C21/F/FJ/FV transfers from byte write function to page write function. After receipt of each word, the three lower  
order address bits are internally incremented by one, while the high order four bits of the word address remains  
constant.  
If the master transmits more than eight words, prior to generating the STOP condition, the address counter will “roll  
over,” and the previous transmitted data will be overwritten.  
S
T
A
R
T
W
R
I
T
E
S
T
O
P
SLAVE  
ADDRESS  
WORD  
ADDRESS  
DATA(n)  
DATA(n+7)  
SDA  
LINE  
WA  
6
WA  
0
＊＊＊  
1 0 1 0  
D7  
D0  
D0  
*
R A  
A
C
K
A
C
K
A
C
K
/ C  
WK  
VCLK  
*:Don’t care  
Fig.11 Page Write Cycle Timing  
○Current Read  
The BR24C21/F/FJ/FV contains an internal address counter which maintains the address of the last word accessed,  
incremented by one. If the last accessed address is address “n” in a Read operation, the next Read operation will  
access data from address “n+1” and increment the current address counter. If the last accessed address is address  
”n” in a Write operation, the next Read operation will access data from address “n”. If the Master does not transfer an  
Acknowledge, but does generate a STOP condition, the current address read operation will only provide a single byte of  
data. At this point, the device discontinues transmission.  
(See Fig.14 Sequential Read Cycle Timing)  
S
R
E
A
D
S
T
O
P
T
A
R
T
SLAVE  
ADRESS  
DATA  
SDA  
LINE  
＊ ＊ ＊  
1
0
1
0
D7  
D0  
R
A
C
K
A
C
K
/
W
*:Don’t care  
Fig.12 Current Read Cycle Timing  
www.rohm.com  
© 2011 ROHM Co., Ltd. All rights reserved.  
2011.08 - Rev.C  
6/22  
1...3456789...23

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