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BS62LV4008SCG70

更新时间: 2024-02-04 13:33:15
品牌 Logo 应用领域
BSI 存储内存集成电路静态存储器光电二极管
页数 文件大小 规格书
10页 374K
描述
Very Low Power/Voltage CMOS SRAM 512K X 8 bit

BS62LV4008SCG70 技术参数

是否Rohs认证:符合生命周期:Obsolete
包装说明:SOP, SOP32,.56Reach Compliance Code:unknown
风险等级:5.84Is Samacsys:N
最长访问时间:70 nsI/O 类型:COMMON
JESD-30 代码:R-PDSO-G32长度:20.447 mm
内存密度:4194304 bit内存集成电路类型:STANDARD SRAM
内存宽度:8湿度敏感等级:3
功能数量:1端子数量:32
字数:524288 words字数代码:512000
工作模式:ASYNCHRONOUS最高工作温度:70 °C
最低工作温度:组织:512KX8
输出特性:3-STATE封装主体材料:PLASTIC/EPOXY
封装代码:SOP封装等效代码:SOP32,.56
封装形状:RECTANGULAR封装形式:SMALL OUTLINE
并行/串行:PARALLEL电源:2.5/3.3 V
认证状态:Not Qualified座面最大高度:2.997 mm
最大待机电流:8e-7 A最小待机电流:1.5 V
子类别:SRAMs最大压摆率:0.024 mA
最大供电电压 (Vsup):3.6 V最小供电电压 (Vsup):2.4 V
标称供电电压 (Vsup):3 V表面贴装:YES
技术:CMOS温度等级:COMMERCIAL
端子形式:GULL WING端子节距:1.27 mm
端子位置:DUAL宽度:11.303 mm
Base Number Matches:1

BS62LV4008SCG70 数据手册

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BSI  
BS62LV4008  
„ KEY TO SWITCHING WAVEFORMS  
„AC TEST CONDITIONS  
(Test Load and Input/Output Reference)  
Input Pulse Levels  
Vcc / 0V  
WAVEFORM  
INPUTS  
OUTPUTS  
MUST BE  
STEADY  
MUST BE  
STEADY  
Input Rise and Fall Times  
1V/ns  
MAY CHANGE  
FROM H TO L  
WILL BE  
CHANGE  
FROM H TO L  
Input and Output  
Timing Reference Level  
0.5Vcc  
MAY CHANGE  
FROM L TO H  
WILL BE  
CHANGE  
FROM L TO H  
Output Load  
CL = 30pF+1TTL  
CL = 100pF+1TTL  
,
DON T CARE:  
CHANGE :  
STATE  
UNKNOWN  
ANY CHANGE  
PERMITTED  
DOES NOT  
APPLY  
CENTER  
LINE IS HIGH  
IMPEDANCE  
”OFF ”STATE  
„ AC ELECTRICAL CHARACTERISTICS ( TA = -40 to + 85oC )  
READ CYCLE  
JEDEC  
PARAMETER  
NAME  
CYCLE TIME : 70ns  
(Vcc = 2.7~3.6V)  
MIN. TYP. MAX.  
CYCLE TIME : 55ns  
(Vcc = 3.0~3.6V)  
PARAMETER  
DESCRIPTION  
Read Cycle Time  
UNIT  
NAME  
MIN.  
TYP.  
MAX.  
tAVAX  
tAVQV  
tELQV  
tGLQV  
tELQX  
tGLQX  
tEHQZ  
tGHQZ  
tRC  
55  
--  
--  
--  
70  
--  
--  
--  
--  
--  
--  
--  
--  
--  
--  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
tAA  
Address Access Time  
--  
55  
55  
30  
--  
70  
70  
35  
--  
tACS  
tOE  
Chip Select Access Time  
--  
--  
--  
Output Enable to Output Valid  
Chip Select to Output Low Z  
Output Enable to Output in Low Z  
Chip Deselect to Output in High Z  
Output Disable to Output in High Z  
--  
--  
--  
tCLZ  
tOLZ  
tCHZ  
tOHZ  
10  
10  
--  
--  
10  
10  
--  
--  
--  
--  
--  
30  
25  
35  
30  
--  
--  
--  
tAXOX  
tOH  
Data Hold from Address Change  
10  
--  
--  
10  
--  
--  
ns  
„ SWITCHING WAVEFORMS (READ CYCLE)  
READ CYCLE1 (1,2,4)  
t
RC  
ADDRESS  
t
AA  
t
OH  
t
OH  
D OUT  
Revision 1.1  
Jan. 2004  
R0201-BS62LV4008  
4

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