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ATF1502ASL-25JC84

更新时间： 2024-11-08 22:05:51
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爱特美尔 - ATMEL 可编程只读存储器
页数 文件大小 规格书
18页 347K
描述
High Performance E2PROM CPLD

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ATF1502ASL-25JC84 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：LPCC包装说明：QCCJ,
针数：44Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.87
最大时钟频率：60 MHzJESD-30 代码：S-PQCC-J44
JESD-609代码：e0长度：16.5862 mm
湿度敏感等级：2专用输入次数：
I/O 线路数量：32端子数量：44
最高工作温度：70 °C最低工作温度：
组织：0 DEDICATED INPUTS, 32 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装形状：SQUARE封装形式：CHIP CARRIER
峰值回流温度（摄氏度）：225可编程逻辑类型：EE PLD
传播延迟：25 ns认证状态：Not Qualified
座面最大高度：4.57 mm最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：YES温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：16.5862 mm

ATF1502ASL-25JC84 数据手册

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Features  
• High Density, High Performance Electrically Erasable Complex Programmable Logic  
Device  
– 32 Macrocells  
– 5 Product Terms per Macrocell, Expandable up to 40 per Macrocell  
– 44 pin  
– 7.5 ns Maximum Pin-to-Pin Delay  
– Registered Operation Up To 125 MHz  
– Enhanced Routing Resources  
• In-System Programmability (ISP) via JTAG  
• Flexible Logic Macrocell  
High  
Performance  
E2PROM CPLD  
– D/T/Latch Configurable Flip Flops  
– Global and Individual Register Control Signals  
– Global and Individual Output Enable  
– Programmable Output Slew Rate  
– Programmable Output Open Collector Option  
– Maximum Logic utilization by burying a register with a COM output  
• Advanced Power Management Features  
– Automatic 3 mA Stand-By for “L” Version  
– Pin-Controlled 4 mA Stand-By Mode (Typical)  
– Programmable Pin-Keeper Inputs and I/Os  
– Reduced-Power Feature Per Macrocell  
• Available in Commercial and Industrial Temperature Ranges  
• Available in 44-pin PLCC; TQFP; and PQFP  
• Advanced EEPROM Technology  
ATF1502AS  
Preliminary  
– 100% Tested  
– Completely Reprogrammable  
– 100 Program/Erase Cycles  
– 20 Year Data Retention  
– 2000V ESD Protection  
– 200 mA Latch-Up Immunity  
• JTAG Boundary-Scan Testing to IEEE Std. 1149.1-1990 and 1149.1a-1993 Supported  
• PCI-compliant  
• 3.3 or 5.0V I/O pins  
• Security Fuse Feature  
Enhanced Features  
• Improved Connectivity (Additional Feedback Routing, Alternate Input Routing)  
• Output Enable Product Terms  
• D - Latch Mode  
• Combinatorial Output with Registered Feedback within any Macrocell  
• Three Global Clock Pins  
• ITD (Input Transition Detection) Circuits on Global Clocks, Inputs and I/O  
• Fast Registered Input from Product Term  
• Programmable “Pin-Keeper” Option  
• VCC Power-Up Reset Option  
• Pull-Up Option on JTAG Pins TMS and TDI  
• Advanced Power Management Features  
– Edge Controlled Power Down “L”  
– Individual Macrocell Power Option  
– Disable ITD on Global Clocks, Inputs and I/O  
Rev. 0995A–04/98  
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型号 品牌 获取价格 描述 数据表
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