AT69170E-DX-ESCC

更新时间： 2024-09-27 06:38:23

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描述
Space FPGA Configuration Memory

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AT69170E-DX-ESCC 技术参数

生命周期：	Obsolete	零件包装代码：	DFP
包装说明：	DFP,	针数：	18
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.2.C
HTS代码：	8542.39.00.01	风险等级：	5.82
最大时钟频率：	0.4 MHz	JESD-30 代码：	R-PDFP-F18
端子数量：	18	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	DFP	封装形状：	RECTANGULAR
封装形式：	FLATPACK	可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY
认证状态：	Not Qualified	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子形式：	FLAT
端子位置：	DUAL	Base Number Matches：	1

AT69170E-DX-ESCC 数据手册

Features

4Mbits x1 Non Volatile Memory Designed to Store Field Programmable Gate

•

Arrays (FPGAs) Configurations

•

In-System Programming (ISP) via Two-Wire Bus

Simple Interface to SRAM FPGAs

Compatible with Atmel AT40KEL040 and ATF280E FPGAs

Cascadable Read-back to Support Additional Configurations or Higher-density Arrays

Low-power RadHard non volatile CMOS process

Programmable Reset Polarity

Space FPGA

Configuration

Memory

Low-power Dissipation

– Active read: 18mW max

– Standby mode: 3.6mW max

•

High-reliability

– Endurance: 50,000 Write Cycles (page mode)

– Data Retention: 10 Years

4Mbits On-chip Flash Array

AT69170E

– 512 bytes Page Write

•

No Single Event Latch-up below a LET Threshold of 80MeV/mg/cm²

Tested up to a Total Dose of 60KRads (Si) (according to MIL STD 883 Method 1019)

Operating Range:

– Voltage: 3V to 3.6V

– Temperature: -55 to +125°C

•

Quality Grades:

– QML-Q or V

– ESCC

•

Package: 305 Mils FP18

Mass: 10 grams

Advanced

1. Description

Information

The AT69170E FPGA configuration memory (configurator) is an electrically erasable

and re-programmable RadHard memory organized as 4Mx1bit. It is an easy-to-use

and cost-effective configuration memory for space Field Programmable Grid Array

(FPGA). It is manufactured with ATMEL 0.18µm low power non volatile CMOS

RadHard process.

It is packaged in a 18-pin 305 Mils wide Flat Pack package. AT69170E uses a simple

serial-access procedure to configure one or more FPGA devices. A two wire interface

(TWI) is available for memory programming.

The user can select the polarity of the reset function by programming a dedicated test

sequence. These devices also support a write-protection mechanism within its pro-

gramming mode.

The factory blanks devices to all ‘1’ before shipping.

7752A–AERO–07/07

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