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AS4C1M16E5-50JC

更新时间: 2024-02-18 20:37:28
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ALSC 动态存储器
页数 文件大小 规格书
22页 601K
描述
5V 1M×16 CMOS DRAM (EDO)

AS4C1M16E5-50JC 技术参数

是否Rohs认证: 不符合生命周期:Obsolete
零件包装代码:TSOP2包装说明:TSOP2, TSOP44/50,.46,32
针数:50Reach Compliance Code:unknown
ECCN代码:EAR99HTS代码:8542.32.00.02
风险等级:5.24访问模式:FAST PAGE WITH EDO
最长访问时间:50 ns其他特性:RAS ONLY/CAS BEFORE RAS/HIDDEN REFRESH
I/O 类型:COMMONJESD-30 代码:R-PDSO-G44
JESD-609代码:e0长度:20.95 mm
内存密度:16777216 bit内存集成电路类型:EDO DRAM
内存宽度:16功能数量:1
端口数量:1端子数量:44
字数:1048576 words字数代码:1000000
工作模式:ASYNCHRONOUS最高工作温度:85 °C
最低工作温度:-40 °C组织:1MX16
输出特性:3-STATE封装主体材料:PLASTIC/EPOXY
封装代码:TSOP2封装等效代码:TSOP44/50,.46,32
封装形状:RECTANGULAR封装形式:SMALL OUTLINE, THIN PROFILE
电源:5 V认证状态:Not Qualified
刷新周期:1024座面最大高度:1.2 mm
自我刷新:YES最大待机电流:0.001 A
子类别:DRAMs最大压摆率:0.145 mA
最大供电电压 (Vsup):5.5 V最小供电电压 (Vsup):4.5 V
标称供电电压 (Vsup):5 V表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:Tin/Lead (Sn/Pb)端子形式:GULL WING
端子节距:0.8 mm端子位置:DUAL
宽度:10.16 mmBase Number Matches:1

AS4C1M16E5-50JC 数据手册

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AS4C1M16E5  
®
Absolute maximum ratings  
Parameter  
Symbol  
Vin  
Min  
-1.0  
-1.0  
-1.0  
-65  
Max  
Unit  
Input voltage  
+7.0  
VCC + 0.5  
+7.0  
+150  
260 × 10  
1
V
Input voltage (DQs)  
VDQ  
V
Power supply voltage  
Storage temperature (plastic)  
Soldering temperature × time  
Power dissipation  
VCC  
V
TSTG  
°C  
oC × sec  
TSOLDER  
PD  
W
Short circuit output current  
Iout  
50  
mA  
Truth table  
Addresses  
Operation  
Standby  
RAS  
LCAS  
H to X  
L
UCAS  
H to X  
L
WE  
X
OE  
X
tR  
tC  
X
DQ0 to DQ15  
High-Z  
Notes  
H
L
X
Word read  
H
L
ROW  
COL  
Data out  
Lower byte  
read  
Lower byte,  
Upper byte, Data out  
L
L
L
L
L
L
H
L
H
L
H
H
L
L
L
ROW  
ROW  
ROW  
ROW  
ROW  
COL  
COL  
COL  
COL  
COL  
Upper byte  
read  
Lower byte,  
Data out, Upper byte  
Word  
(early) write  
L
X
X
X
Data in  
Lower byte  
(early) write  
Lower byte, Data in,  
Upper byte, High-Z  
L
H
L
L
Upper byte  
(early) write  
Lower byte, High-Z,  
Upper byte, Data in  
H
L
Read write  
EDO read  
L
L
L
L
L
L
L
L
L
L
H to L L to H ROW  
COL  
COL  
COL  
n/a  
Data out, Data in  
Data out  
1,2  
2
1st cycle  
2nd cycle  
Any cycle  
1st cycle  
2nd cycle  
1st cycle  
2nd cycle  
H to L  
H to L  
L to H  
H to L  
H to L  
H to L  
H to L  
H to L  
H to L  
L to H  
H to L  
H to L  
H
H
H
L
L
L
ROW  
n/a  
Data out  
2
L
n/a  
Data out  
2
X
X
ROW  
n/a  
COL  
COL  
COL  
COL  
Data in  
1
EDO write  
L
Data in  
1
H to L H to L L to H ROW  
Data out, Data in  
Data out, Data in  
1,2  
1,2  
EDO  
read write  
H to L H to L L to H  
n/a  
ROW  
X
RAS only  
refresh  
L
H
L
H
L
X
X
X
n/a  
X
High Z  
High Z  
CBR refresh  
H to L  
H
3
4/11/01; v.1.0  
Alliance Semiconductor  
P. 3 of 22  

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