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AK8181C

更新时间： 2024-02-18 17:55:10

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AKM		时钟
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8页	446K
描述
3.3V LVPECL 1:2 Clock Fanout Buffer

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AK8181C 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	LQFP, QFP32,.35SQ,32	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.75
系列：	8181	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	S-PQFP-G32	长度：	7 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	32
实输出次数：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装等效代码：	QFP32,.35SQ,32
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	2.375/3.8 V
认证状态：	Not Qualified	座面最大高度：	1.6 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.8 V
最小供电电压 (Vsup)：	2.375 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7 mm
最小 fmax：	700 MHz	Base Number Matches：	1

AK8181C 数据手册

AK8181C

Function Table

The following table shows the inputs/outputs clock state configured through the control pins.

Table 1: Control Input Function Table

Inputs

Outputs

CLK_EN

CLK_SEL

Selected Source

CLK0

Q0, Q1

Disabled: Low

Enabled

Q0n, Q1n

Disabled: High

Enabled

0 (Open)

CLK1

1 (Open)

CLK0

CLK1

Enabled

After CLK_EN switches, the clock outputs are disabled or enabled following a rising and falling input clock edge

as shown in Figure 7. In the active mode, the state of the outputs are a function of the CLK0 and CLK1 inputs as

described in Table 2.

Disabled

Enabled

CLK0, CLK1

CLK_EN

Q0n : Q3n

Q0 : Q3

Figure 7 CLK_EN Timing Diagram

Table 2 Clock Input Function Table

Inputs

Outputs

CLK0 or CLK1

Q0, Q1

Q0n, Q1n

Low

High

Low

High

Feb-2013

draft-E-01

- 6 -

1...3 4 567 8

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