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AK8181F

更新时间： 2024-01-14 10:45:11

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AKM		时钟
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12页	654K
描述
3.3V LVDS 1:4 Clock Fanout Buffer

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AK8181F 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	LQFP, QFP32,.35SQ,32	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.75
系列：	8181	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	S-PQFP-G32	长度：	7 mm
逻辑集成电路类型：	LOW SKEW CLOCK DRIVER	功能数量：	1
反相输出次数：		端子数量：	32
实输出次数：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装等效代码：	QFP32,.35SQ,32
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	2.375/3.8 V
认证状态：	Not Qualified	座面最大高度：	1.6 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.8 V
最小供电电压 (Vsup)：	2.375 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7 mm
最小 fmax：	700 MHz	Base Number Matches：	1

AK8181F 数据手册

AK8181F

3.3V LVDS 1:4

Preliminary Clock Fanout Buffer

AK8181F

Features

Description

The AK8181F is a member of AKM’s LVDS clock

fanout buffer family designed for telecom,

networking and computer applications, requiring a

range of clocks with high performance and low

skew. The AK8181F distributes 4 buffered clocks.

Four differential 3.3V LVDS outputs

Selectable differential PCLK0p/n or LVPECL

clock inputs

PCLK0p/n pair can accept the following

differential input levels; LVDS, LVPECL,

LVHSTL, SSTL, HCSL

PCLK1p/n supports the following input types;

LVPECL, CML, SSTL

AK8181F are derived from AKM’s long-term-

experienced clock device technology, and enable

clock output to perform low skew. The AK8181F is

available in a 20-pin TSSOP package.

Clock output frequency up to 650MHz

Translates any single-ended input signal to

3.3V LVDS levels with resistor bias on

PCLK0n input

Output skew : 30ps (maximum)

Part-to-part skew : 600ps (maximum)

Propagation delay : 2.5ns (maximum)

Operating Temperature Range: -40 to +85℃

Package: 20-pin TSSOP (Pb free)

Pin compatible with ICS8543I

Block Diagram

draft-E-02

Dec-2012

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型号	品牌	描述	获取价格	数据表
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