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AK8152

更新时间： 2022-06-12 15:36:10

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AKM		时钟发生器
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21页	505K
描述
Single PLL Two Output Clock Generator

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AK8152 数据手册

[AK8152]

２－６）シリアルインタフェース

２－６－１） SDA/SCL 入出力特性

VDD=1.7-1.9V，VDDO1,2 =1.7-2.8V Ta=-20～85℃

項目

適用端子

記号

V_LH

Vi_L

単位

MIN

0.7*VDD

VSS

TYP

MAX

3.6

SDA/SCL⁽¹⁾

高レベル入力電圧

低レベル入力電圧

0.3*VDD

シュミットトリガ入力の

ヒステリシス

SDA/SCL

V_hys

160m

低レベル出力電圧

(シンク電流 3mA 時)

SDA

V_OL

I_i

0.2*VDD

入力電流

SDA/SCL

-10

μA

入力フィルタで抑圧される

スパイクのパルス幅

TSP

C_i

入力容量

(1)SDA、SCL 端子は 3.6V 耐圧

２－６－２） 2 線式デジタルインタフェースバスライン特性

項目

記号

fSCL

tBUF

単位

Min

Typ

Max

SCL クロック周波数

400

kHz

バスフリー時間(ストップ条件とスタート条件の間)

1.3

0.6

スタート条件ホールド時間

tHD:STA

(この後、最初のクロックパルスを生成)

SCL クロックの”L”期間

tLOW

tHIGH

tSU:STA

tHD:DAT

tSU:DAT

1.3

0.6

SCL クロックの”H”期間

反復スタート条件のセットアップ時間

データホールド時間

データセットアップ時間

0.1

SDA 及び SCL 信号の立ち上がり時間

SDA 及び SCL 信号の立ち下がり時間

ストップ条件のセットアップ時間

バスラインの容量性負荷

0.3

tSU:STO

0.6

200

draft-J-00b

- 6 -

2010/3

1...3 4 567 8 9...21

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