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AK8152

更新时间： 2022-06-12 15:36:10

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AKM		时钟发生器
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21页	505K
描述
Single PLL Two Output Clock Generator

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AK8152 数据手册

[AK8152]

１．端子説明

１－１）端子配置図

1:CLKOUT1

10: VDD

9:VSS

2:VDDO1

3:SVSS

4: SDA

8:ICLK

7:VDDO

２

5: SCL

6:CLKOUT

２

１－２）端子機能説明

端子名

(端子タイプ)

端子番号

説明

クロック出力１

PLL出力またはICLK端子入力を分周器DIV1で分周したクロックを出力します。

レジスタCLK1EN=0の時、”L”出力になります(100kΩ プルダウン)。

出力電圧はVDDO1端子で設定します。

CLKOUT1

(DO)

クロック出力端子用電源１

CLKOUT1端子用の電源端子です。1.7～2.8Vを供給して下さい。

グランド

VDDO１

(PWR)

SVSS

(PWR)

シリアルデータ入出力（オープンドレイン）

SDA

(DIO)

2線式デジタルI/Fバス用データ入出力端子です。

1.8V系の入出力ですが、3.6Vまでのバスラインに接続可能です。

シリアルクロック入力

SCL

(DI)

2線式デジタルI/Fバス用クロック入力端子です。

1.8V系の入出力ですが、3.6Vまでのバスラインに接続可能です。

クロック出力２

PLL出力またはICLK端子入力を分周器DIV2で分周したクロックを出力します。

レジスタCLK2EN=0の時、”L”出力になります(100kΩ プルダウン)。

出力電圧はVDDO2端子で設定します。

CLKOUT2

(DO)

クロック出力端子用電源２

VDDO2

（PWR）

CLKOUT2端子用の電源端子です。1.7～2.8Vを供給して下さい。

クロック入力

ICLK

(DI)

入力周波数は、12M/19.2M/26M/27M/48MHzの中から選択します。

1.8V入力です。CLK無入力時はSTBYレジスタを“１”を設定してください。

グランド

VSS

（PWR）

VDD

コア用電源

（PWR）

1.8V±0.1Vを供給して下さい。

draft-J-00b

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2010/3

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