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ADM1067ACPZ

更新时间： 2024-01-17 11:22:19

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亚德诺 - ADI		/
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32页	510K
描述
Super Sequencer® with Open-Loop Margining DACs

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ADM1067ACPZ 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFN
包装说明：	HVQCCN, LCC40,.24SQ,20	针数：	40
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.8
可调阈值：	YES	模拟集成电路 - 其他类型：	POWER SUPPLY SUPPORT CIRCUIT
JESD-30 代码：	S-XQCC-N40	JESD-609代码：	e3
长度：	6 mm	湿度敏感等级：	3
信道数量：	10	功能数量：	1
端子数量：	40	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装等效代码：	LCC40,.24SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：	260	电源：	4.75 V
认证状态：	Not Qualified	座面最大高度：	1 mm
子类别：	Power Management Circuits	标称供电电压 (Vsup)：	4.75 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	40	宽度：	6 mm
Base Number Matches：	1

ADM1067ACPZ 数据手册

Data Sheet

ADM1067

Parameter

Min

Typ

Max

Unit Test Conditions/Comments

SERIAL BUS TIMING³

Clock Frequency, f_SCLK

Bus Free Time, t_BUF

Start Setup Time, t_SU;STA

Stop Setup Time, t_SU;STO

Start Hold Time, t_HD;STA

SCL Low Time, t_LOW

SCL High Time, t_HIGH

SCL, SDA Rise Time, t_R

SCL, SDA Fall Time, t_F

Data Setup Time, t_SU;DAT

Data Hold Time, t_HD;DAT

Input Low Current, I_IL

SEQUENCING ENGINE TIMING

State Change Time

400

kHz

μs

1.3

0.6

1.3

0.6

300

100

μA

V_IN= 0 V

μs

At least one of the VH, VPx pins must be ≥3.0 V to maintain the device supply on VDDCAP.

²Specification is not production tested but is supported by characterization data at initial product release.

³Timing specifications are guaranteed by design and supported by characterization data.

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