Datasheet > 驱动程序和接口 > 其他接口集成电路> ADG3308BCBZ-1-REEL

ADG3308BCBZ-1-REEL

更新时间： 2024-01-01 21:30:14

品牌	Logo	应用领域
亚德诺 - ADI		转换器电平转换器驱动程序和接口接口集成电路
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20页	622K
描述
Low Voltage, 1.15 V to 5.5 V, 8-Channel Bidirectional Logic Level Translators

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ADG3308BCBZ-1-REEL 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	BGA
包装说明：	VFBGA, BGA20,4X5,20	针数：	20
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.13
接口集成电路类型：	INTERFACE CIRCUIT	JESD-30 代码：	R-PBGA-B20
JESD-609代码：	e1	长度：	2.5 mm
湿度敏感等级：	1	功能数量：	1
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	VFBGA	封装等效代码：	BGA20,4X5,20
封装形状：	RECTANGULAR	封装形式：	GRID ARRAY, VERY THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	260	电源：	1.2/5,1.8/5 V
认证状态：	Not Qualified	座面最大高度：	0.65 mm
子类别：	Other Interface ICs	最大供电电压：	5.5 V
最小供电电压：	1.15 V	标称供电电压：	1.8 V
电源电压1-最大：	5.5 V	电源电压1-分钟：	1.65 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Tin/Silver/Copper (Sn95.5Ag4.0Cu0.5)	端子形式：	BALL
端子节距：	0.5 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	40	宽度：	2 mm
Base Number Matches：	1

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ADG3308/ADG3308-1

TERMINOLOGY

V_IHA

D_{MAX, A→Y}

Logic input high voltage at Pin A1 to Pin A8.

Guaranteed data rate when translating logic levels in the A→Y

direction under the driving and loading conditions specified in

Table 1.

V_ILA

Logic input low voltage at Pin A1 to Pin A8.

t_{SKEW, A→Y}

V_OHA

Difference between propagation delays on any two channels

when translating logic levels in the A→Y direction.

Logic output high voltage at Pin A1 to Pin A8.

V_OLA

t_{PPSKEW, A→Y}

Logic output low voltage at Pin A1 to Pin A8.

Difference in propagation delay between any one channel and

the same channel on a different part (under same driving/

loading conditions) when translating in the A→Y direction.

C_A

Capacitance measured at Pin A1 to Pin A8 (EN = 0).

I_{LA, HIGH-Z}

t_{P, Y → A}

Leakage current at Pin A1 to Pin A8 when EN = 0 (high

impedance state at Pin A1 to Pin A8).

Propagation delay when translating logic levels in the Y→A

direction.

V_IHY

t_{R, Y→A}

Logic input high voltage at Pin Y1 to Pin Y8.

Rise time when translating logic levels in the Y→A direction.

V_ILY

t_{F, Y→A}

Logic input low voltage at Pin Y1 to Pin Y8.

Fall time when translating logic levels in the Y→A direction.

V_OHY

D_{MAX, Y→A}

Logic output high voltage at Pin Y1 to Pin Y8.

Guaranteed data rate when translating logic levels in the Y→A

direction under the driving and loading conditions specified in

Table 1.

V_OLY

Logic output low voltage at Pin Y1 to Pin Y8.

C_Y

t_{SKEW, Y→A}

Capacitance measured at Pin Y1 to Pin Y8 (EN = 0).

Difference between propagation delays on any two channels

when translating logic levels in the Y→A direction.

I_{LY, HIGH-Z}

Leakage current at Pin Y1 to Pin Y8 when EN = 0 (high

impedance state at Pin Y1 to Pin Y8).

t_{PPSKEW, Y→A}

Difference in propagation delay between any one channel and

the same channel on a different part (under same driving/

loading conditions) when translating in the Y→A direction.

V_IHEN

Logic input high voltage at the EN pin.

V_CCA

V_ILEN

V_CCAsupply voltage.

Logic input low voltage at the EN pin.

V_CCY

C_EN

V_CCYsupply voltage.

Capacitance measured at EN pin.

I_CCA

I_LEN

V_CCAsupply current.

Enable (EN) pin leakage current.

I_CCY

t_EN

V_CCYsupply current.

Three-state enable time for Pin A1 to Pin A8/Pin Y1 to Pin Y8.

I_HIGH-ZA

t_{P, A → Y}

V_CCAsupply current during three-state mode (EN = 0).

Propagation delay when translating logic levels in the A→Y

direction.

I_HIGH-ZY

V_CCYsupply current during three-state mode (EN = 0).

t_{R, A→Y}

Rise time when translating logic levels in the A→Y direction.

t_{F, A→Y}

Fall time when translating logic levels in the A→Y direction.

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