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ADC12DJ5200-EP

更新时间： 2023-09-03 20:36:34
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德州仪器 - TI /
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214页 8028K
描述
具有双通道 5.2GSPS 或单通道 10.4GSPS 的增强型 12 位 ADC

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ADC12DJ5200-EP 数据手册

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ADC12DJ5200-EP  
ZHCSQC1C –JUNE 2022 –REVISED MARCH 2023  
ADC12DJ5200-EP 10.4GSPS 单通道或5.2GSPS 双通道  
12 位射频采样模数转换器(ADC)  
1 特性  
3 描述  
• 高可靠性增强型产品：  
ADC12DJ5200-EP 器件是一款射频采样千兆采样模数  
转换器 (ADC)，可对从直流到 10GHz 以上的输入频率  
进行直接采样。 ADC12DJ5200-EP 可配置为双通道  
5.2GSPS ADC 或单通道 10.4GSPS ADC。支持高达  
10GHz 的可用输入频率范围，可对频率捷变系统的  
L、S、C 和X 频带进行直接射频采样。  
– 受控基线：一个组装和测试基地、一个制造基  
地、更长的产品生命周期、更长的产品变更通知  
周期和产品可追溯性  
• ADC 内核：  
– 12 位分辨率  
– 单通道模式下的采样率高达10.4 GSPS  
– 双通道模式下的采样率高达5.2 GSPS  
• 性能规格：  
– 本底噪声（-20 dBFS，VFS = 1VPP-DIFF）：  
• 双通道模式：-151.8 dBFS/Hz  
• 单通道模式：-154.4 dBFS/Hz  
– ENOB（双通道，FIN = 2.4 GHz）：8.6 位  
• VCMI 为0V 时的缓冲模拟输入：  
– 模拟输入带宽(-3dB)：8 GHz  
– 可用输入频率范围：> 10 GHz  
– 满量程输入电压（VFS，默认值）：0.8 VPP  
• 无噪声孔径延迟(tAD) 调节：  
ADC12DJ5200-EP 使用具有多达 16 个串行通道的高  
速JESD204C 输出接口，支持高达17.16Gbps 的线路  
速率。通过 JESD204C 子类 1 支持确定性延迟和多器  
件同步。JESD204C 接口可进行配置，对线路速率和  
通道数进行权衡。支持 8b/10b 和 64b/66b 数据编码方  
案。64b/66b 编码支持前向纠错 (FEC)，可改进误码  
率。此接口向后兼容JESD204B 接收器。  
无噪声孔径延迟调节和 SYSREF 窗口等创新的同步特  
性可简化多通道应用的系统设计。提供可选的数字下变  
频器 (DDC)，以便将数字信号频谱下变频到基带信号  
并降低接口速率。可编程 FIR 滤波器可实现片上均  
衡。  
– 精确采样控制：19 fs 步长  
– 简化同步和交错  
– 温度和电压不变延迟  
• 简便易用的同步特性：  
封装信息  
封装(1)  
封装尺寸（标称值）  
器件型号  
ADC12DJ5200-EP  
FCBGA (144) 10.00mm × 10.00mm  
– 自动SYSREF 计时校准  
– 样片标记时间戳  
(1) 如需了解所有可用封装，请参阅产品说明书末尾的封装选项附  
录。  
• JESD204C 串行数据接口：  
NCOA0 NCOA1 NCOB0 NCOB1 CALTRG PD  
SCLK  
– 最大通道速率：17.16 Gbps  
– 支持64b/66b 和8b/10b 编码  
– 8b/10b 模式兼容JESD204B  
• 可选数字下变频器(DDC)：  
SDI  
SDO  
SCS\  
SPI Registers and  
Device Control  
TMSTP+  
TMSTP-  
DA0+  
DA0-  
Crossbar MUX  
or Interleaving  
Input  
MUX  
JESD204C  
Link  
ADC  
A
A
INA+  
INA-  
Digital Down  
Converter (DDC)  
Block  
DA7+  
DA7-  
Over-  
range  
PFIR  
Block  
DDC Options:  
DDC Bypass  
SYNCSE\  
– 4 倍、8 倍、16 倍和32 倍复杂抽取  
– 每个DDC 均具有四个独立的32 位NCO  
• 峰值射频输入功率(Diff)：+26.5 dBm（+ 27.5  
dBFS，560x 满量程功率）  
• 可实现均衡的可编程FIR 滤波器  
• 功耗：4W  
Decimate-by-4  
Decimate-by-8  
Decimate-by-16  
Decimate-by-32  
DB0+  
DB0-  
INB+  
INB-  
Input  
MUX  
JESD204C  
Link  
ADC  
B
B
DB7+  
DB7-  
Aperture  
Delay Adjust  
JMODE  
CLK+  
CLK-  
Clock Distribution  
and Synchronization  
ORA0  
ORA1  
ORB0  
ORB1  
Status  
Indicators  
SYSREF+  
SYSREF-  
SYSREF  
Windowing  
CALSTAT  
TDIODE+  
TDIODE-  
• 电源：1.1V/1.9V  
ADC12DJ5200-EP 方框图  
2 应用  
• 宽带数字转换器  
• 电子战（信号情报、电子情报）  
• 卫星通信(SATCOM)  
• 射频采样软件定义无线电(SDR)  
本文档旨在为方便起见，提供有关TI 产品中文版本的信息，以确认产品的概要。有关适用的官方英文版本的最新信息，请访问  
www.ti.com，其内容始终优先。TI 不保证翻译的准确性和有效性。在实际设计之前，请务必参考最新版本的英文版本。  
English Data Sheet: SLVSGV2  
 
 
 
 
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