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Datasheet > 电信电路 > ATM/SONET/SDH 集成电路> AD9552BCPZ
AD9552BCPZ PDF预览

AD9552BCPZ

更新时间： 2024-02-08 01:46:25
品牌 Logo 应用领域
亚德诺 - ADI 振荡器ATM集成电路SONET集成电路SDH集成电路电信集成电路电信电路异步传输模式PC
页数 文件大小 规格书
32页 477K
描述
Oscillator Frequency Upconverter

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AD9552BCPZ 技术参数

是否无铅：含铅是否Rohs认证：符合
生命周期：Active零件包装代码：QFN
包装说明：HVQCCN, LCC32,.2SQ,20针数：32
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.48
Samacsys Confidence：Samacsys Status：Released
Schematic Symbol：https://componentsearchengine.com/symbol.php?partID=372609PCB Footprint：https://componentsearchengine.com/footprint.php?partID=372609
Samacsys PartID：372609Samacsys Image：https://componentsearchengine.com/Images/9/AD9552BCPZ.jpg
Samacsys Thumbnail Image：https://componentsearchengine.com/Thumbnails/1/AD9552BCPZ.jpgSamacsys Pin Count：33
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Other
Samacsys Footprint Name：QFN50P500X500X100-33NSamacsys Released Date：2017-01-11 11:21:59
Is Samacsys：N应用程序：SONET;SDH
JESD-30 代码：S-XQCC-N32JESD-609代码：e3
长度：5 mm湿度敏感等级：3
功能数量：1端子数量：32
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装等效代码：LCC32,.2SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
座面最大高度：1 mm子类别：Other Telecom ICs
最大压摆率：0.169 mA标称供电电压：3.3 V
表面贴装：YES技术：CMOS
电信集成电路类型：ATM/SONET/SDH SUPPORT CIRCUIT温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：5 mm
Base Number Matches：1

AD9552BCPZ 数据手册

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AD9552  
SPECIFICATIONS  
Minimum (min) and maximum (max) values apply for the full range of supply voltage and operating temperature variations. Typical (typ)  
values apply for VDD = 3.3 V; TA = 25°C, unless otherwise noted.  
Table 1.  
Parameter  
Min  
Typ  
Max  
Unit  
Test Conditions/Comments  
SUPPLY VOLTAGE  
POWER CONSUMPTION  
Total Current  
VDD Current By Pin  
Pin 7  
Pin 18  
Pin 21  
Pin 28  
LVPECL Output Driver  
3.135 3.30  
3.465  
V
Pin 7, Pin 18, Pin 21, Pin 28  
149  
169  
mA  
At maximum output frequency with both output channels active  
2
3
mA  
mA  
mA  
mA  
mA  
77  
35  
35  
36  
86  
41  
41  
41  
900 MHz with 100 Ω termination between both pins of the output  
driver  
LOGIC INPUT PINS  
INPUT CHARACTERISTICS1  
Logic 1 Voltage, VIH  
1.0  
V
For the CMOS inputs, a static Logic 1 results from either a pull-up  
resistor or no connection  
Logic 0 Voltage, VIL  
Logic 1 Current, IIH  
Logic 0 Current, IIL  
0.8  
3
17  
V
μA  
μA  
LOGIC OUTPUT PINS  
Output Characteristics  
Output Voltage High, VOH  
Output Voltage Low, VOL  
RESET PIN  
Input Characteristics2  
Input Voltage High, VIH  
Input Voltage Low, VIL  
Input Current High, IINH  
Input Current Low, IINL  
Minimum Pulse Width High  
2.7  
1.8  
V
V
0.4  
V
V
μA  
μA  
ns  
1.3  
12.5  
43  
0.3  
31  
2
REFERENCE CLOCK  
INPUT CHARACTERISTICS  
Frequency Range  
7.94  
6.57  
MHz  
MHz  
N3 = 255; 2× frequency multiplier enabled; valid for all VCO bands  
N3 = 255; 2× frequency multiplier enabled; fVCO = 3.35 GHz, which con-  
strains the frequency at OUT1 to be an integer sub-multiple of 3.35 GHz  
(that is, fOUT1 = 3.35 ÷ M GHz, where M is the product of the P0 and P1  
output divider values)  
93.06 MHz  
71.28 MHz  
112.5 MHz  
SDM4 disabled; N3 = 365; valid for all VCO bands  
SDM4 enabled; N3 = 476; valid for all VCO bands  
SDM4 disabled; N3 = 365; fVCO = 4.05 GHz, which constrains the  
frequency at OUT1 to be an integer sub-multiple of 4.05 GHz (that is,  
fOUT1 = 4.05÷M GHz, where M is the product of the P0 and P1 output  
divider values)  
86.17 MHz  
SDM4 enabled; N3 = 476; fVCO = 4.05 GHz, which constrains the frequency  
at OUT1 to be an integer sub-multiple of 4.05 GHz (that is, fOUT1  
=
4.05÷M GHz, where M is the product of the P0 and P1 output divider  
values)  
Rev. C | Page 3 of 32  
 
 
 
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