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AD9550/PCBZ

更新时间： 2024-01-01 05:27:29

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亚德诺 - ADI		通信时钟
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20页	393K
描述
Integer-N Clock Translator for Wireline Communications

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AD9550/PCBZ 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFN
包装说明：	HVQCCN, LCC32,.2SQ,20	针数：	32
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.79
应用程序：	SONET;SDH	JESD-30 代码：	S-XQCC-N32
JESD-609代码：	e3	长度：	5 mm
湿度敏感等级：	1	功能数量：	1
端子数量：	32	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装等效代码：	LCC32,.2SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	260	电源：	3.3 V
认证状态：	Not Qualified	座面最大高度：	0.8 mm
子类别：	Other Telecom ICs	最大压摆率：	0.185 mA
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	电信集成电路类型：	ATM/SONET/SDH SUPPORT CIRCUIT
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	5 mm	Base Number Matches：	1

AD9550/PCBZ 数据手册

AD9550

Parameter

Min

Typ

Max

Unit Test Conditions/Comments

CMOS MODE

Output Voltage High, V_OH

I_OH= 10 mA

I_OH= 1 mA

Output driver static

2.8

Output Voltage Low, V_OL

I_OL= 10 mA

I_OL= 1 mA

Output driver static

0.5

0.3

200

Frequency Range

MHz 3.3 V CMOS; output toggle rates in excess of the

maximum are possible, but with reduced amplitude

(see Figure 14)

Duty Cycle

Rise/Fall Time¹(20% to 80%)

745

At maximum output frequency

3.3 V CMOS; 10 pF load

500

¹The listed values are for the slower edge (rise or fall).

JITTER CHARACTERISTICS

Table 3.

Parameter

Min

Typ

Max

Unit

Test Conditions/Comments

JITTER GENERATION

Output

12 kHz to 20 MHz

LVPECL

1.31

1.28

0.89

ps rms

Input = 122.88 MHz, output = 155.52 MHz

Input = 19.44 MHz, output = 245.76 MHz

Input = 25 MHz, output = 125 MHz, Pin A3 to Pin A0 = 1110, Pin Y5

to Pin Y0 = 111111 (see Figure 3)

LVDS Output

CMOS Output

1.32

1.29

1.24

1.26

ps rms

Input = 122.88 MHz, output = 155.52 MHz

Input = 19.44 MHz, output = 245.76 MHz

Input = 122.88 MHz, output = 155.52 MHz

Input = 19.44 MHz, output = 245.76 MHz, see Figure 14 regarding

CMOS toggle rates above 250 MHz

50 kHz to 80 MHz

LVPECL

Input = 122.88 MHz, output = 155.52 MHz

Input = 19.44 MHz, output = 245.76 MHz

Input = 25 MHz, output = 125 MHz, Pin A3 to Pin A0 = 1110, Pin Y5

to Pin Y0 = 111111 (see Figure 3)

0.44

0.75

0.58

ps rms

LVDS

0.45

0.76

0.39

0.44

ps rms

Input = 122.88 MHz, output = 155.52 MHz

Input = 19.44 MHz, output = 245.76 MHz

Input = 122.88 MHz, output = 155.52 MHz

Input = 19.44 MHz, output = 245.76 MHz, see Figure 14 regarding

CMOS toggle rates above 250 MHz

CMOS

JITTER TRANSFER BANDWIDTH

See the Typical Performance Characteristics section

Bandwidth Setting

Low

Medium

High

170

kHz

JITTER TRANSFER PEAKING

See the Typical Performance Characteristics section

Bandwidth Setting

Low

Medium

High

1.3

0.08

Rev. 0 | Page 5 of 20

1 2 3 456 7 8...20

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