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Datasheet > 暂无类别数据> AD9432BSQZ-80
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AD9432BSQZ-80

更新时间： 2024-02-22 16:37:20
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
16页 517K
描述
12-Bit, 80 MSPS/105 MSPS ADC

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AD9432BSQZ-80 数据手册

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AD9432  
SPECIFICATIONS  
VDD = 3.3 V, VCC = 5.0 V; external reference; differential encode input, unless otherwise noted.  
Table 1.  
Test  
Level  
80 MSPS  
Typ  
105 MSPS  
Typ  
Parameter  
Temp  
Min  
Max  
Min  
Max  
Unit  
RESOLUTION  
12  
12  
Bits  
DC ACCURACY  
Differential Nonlinearity (DNL)  
25°C  
Full  
25°C  
Full  
Full  
25°C  
Full  
I
VI  
I
VI  
VI  
I
−0.75  
−1.0  
−1.0  
−1.5  
0.25  
0.5  
0.5  
1.0  
Guaranteed  
+2  
+0.75  
+1.0  
+1.0  
+1.5  
−0.75  
−1.0  
−1.0  
−1.5  
0.25  
0.5  
0.5  
1.0  
Guaranteed  
+2  
+0.75  
+1.0  
+1.0  
+1.5  
LSB  
LSB  
LSB  
LSB  
Integral Nonlinearity (INL)  
No Missing Codes  
Gain Error1  
Gain Tempco1  
−5  
+7  
−5  
+7  
% FS  
ppm/°C  
V
150  
150  
ANALOG INPUTS (AIN, AIN)  
Input Voltage Range  
Common-Mode Voltage  
Input Offset Voltage  
Input Resistance  
Full  
Full  
Full  
Full  
25°C  
25°C  
V
V
VI  
VI  
V
2
3.0  
0
3
4
2
3.0  
0
3
4
V p-p  
V
mV  
kΩ  
pF  
MHz  
−5  
2
+5  
4
−5  
2
+5  
4
Input Capacitance  
Analog Bandwidth, Full Power  
ANALOG REFERENCE  
Output Voltage  
Tempco  
Input Bias Current  
V
500  
500  
Full  
Full  
Full  
VI  
V
VI  
2.4  
2.5  
50  
15  
2.6  
50  
2.4  
2.5  
50  
15  
2.6  
50  
V
ppm/°C  
μΑ  
SWITCHING PERFORMANCE  
Maximum Conversion Rate  
Minimum Conversion Rate  
Encode Pulse Width High (tEH)  
Encode Pulse Width Low (tEL)  
Aperture Delay (tA)  
Aperture Uncertainty (Jitter)  
Output Valid Time (tV)2  
Output Propagation Delay (tPD)2 Full  
Output Rise Time (tR)2  
Output Fall Time (tF)2  
Out-of-Range Recovery Time  
Transient Response Time  
Latency  
Full  
Full  
VI  
IV  
IV  
IV  
V
80  
105  
MSPS  
MSPS  
ns  
ns  
ns  
ps rms  
ns  
ns  
ns  
ns  
1
1
25°C  
25°C  
25°C  
25°C  
Full  
4.0  
4.0  
6.2  
6.2  
2.0  
0.25  
5.3  
5.5  
2.1  
1.9  
2
4.0  
4.0  
4.8  
4.8  
2.0  
0.25  
5.3  
5.5  
2.1  
1.9  
2
V
VI  
VI  
V
V
V
3.0  
3.0  
8.0  
8.0  
Full  
Full  
25°C  
25°C  
Full  
ns  
ns  
Cycles  
V
IV  
2
10  
2
10  
DIGITAL INPUTS  
Encode Input Common Mode  
Differential Input  
Full  
Full  
V
V
1.6  
750  
1.6  
750  
V
mV  
(ENCODE, ENCODE)  
Single-Ended Input  
Logic 1 Voltage  
Logic 0 Voltage  
Full  
Full  
Full  
25°C  
IV  
IV  
VI  
V
2.0  
3
2.0  
3
V
V
kΩ  
pF  
0.8  
8
0.8  
8
Input Resistance  
5
4.5  
5
4.5  
Input Capacitance  
DIGITAL OUTPUTS  
Logic 1 Voltage (VDD = 3.3 V)  
Logic 0 Voltage (VDD = 3.3 V)  
Output Coding  
Full  
Full  
VI  
VI  
VDD − 0.05  
VDD − 0.05  
V
V
0.05  
0.05  
Twos complement  
Twos complement  
Rev. F | Page 3 of 16  
 
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