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Datasheet > 驱动程序和接口 > 显示驱动器> AD8383ACPZ
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AD8383ACPZ

更新时间： 2024-02-23 13:28:09
品牌 Logo 应用领域
亚德诺 - ADI 显示驱动器驱动程序和接口接口集成电路
页数 文件大小 规格书
16页 474K
描述
Low Cost 10-Bit, 6-Channel Output Decimating LCD DecDriver

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AD8383ACPZ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFN
包装说明：7 X 7 MM, 0.85 MM HEIGHT, MO-220VKKD-2, LFCSP-48针数：48
Reach Compliance Code：unknown风险等级：5.75
Is Samacsys：N数据输入模式：PARALLEL
接口集成电路类型：LIQUID CRYSTAL DISPLAY DRIVERJESD-30 代码：S-XQCC-N48
JESD-609代码：e3长度：7 mm
湿度敏感等级：3复用显示功能：NO
功能数量：1区段数：6
端子数量：48最高工作温度：75 °C
最低工作温度：封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
认证状态：COMMERCIAL座面最大高度：1 mm
标称供电电压：3.3 V电源电压1-Nom：15.5 V
表面贴装：YES温度等级：COMMERCIAL EXTENDED
端子面层：MATTE TIN端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：7 mm
Base Number Matches：1

AD8383ACPZ 数据手册

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AD8383  
SPECIFICATIONS  
Table 1. @25°C, AVCC = 15.5 V, DVCC = 3.3 V, TMIN = 0°C, TMAX = 75°C, VFS = 5 V, VREFLO = V1 = V2 = 7 V,  
unless otherwise noted  
Parameter  
VIDEO DC PERFORMANCE1  
Conditions  
Min  
Typ  
Max  
Unit  
TMIN to TMAX, DAC Code 450 to 800  
VDE  
VCME  
–7.5  
–3.5  
+7.5  
+3.5  
mV  
mV  
REFERENCE INPUTS  
V1, V2 Range  
5
AVCC – 4  
V
V2 to V1 Range  
V1 Input Current  
V2 Input Current  
VREFHI Range  
VREFLO Range  
VREFHI Input Resistance  
VREFLO Bias Current  
VREFHI Input Current  
VFS Range2  
–0.25  
V
+0.2  
–7.5  
µA  
µA  
V
VREFHI ≥ VREFLO  
VREFHI ≥ VREFLO  
To VREFLO  
VREFLO  
V1 – 0.5  
AVCC  
AVCC – 1.3  
V
20  
–0.2  
125  
kΩ  
µA  
µA  
V
0
5.5  
RESOLUTION  
Coding  
Binary  
10  
Bits  
DIGITAL INPUT CHARACTERISTICS  
Maximum Input Data Update Rate3  
CLK to Data Setup Time  
CLK to STSQ Setup Time  
CLK to XFR Setup Time  
CLK to Data Hold Time  
CLK to STSQ Hold Time  
CLK to XFR Hold Time  
CLK High Time  
CLK Low Time  
100  
0
1
1
3
3
3
3
2.5  
Ms/s  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
pF  
µA  
µA  
µA  
V
CIN  
IIH  
IIL  
IIL, CLK  
3
0.05  
0.6  
1.2  
VIH  
2
VIL  
0.8  
V
VTH  
1.5  
V
VIDEO OUTPUT CHARACTERISTICS  
Output Voltage Swing  
CLK to VID Delay4  
INV to VID Delay  
Output Current  
Output Resistance  
AVCC – VOH, VOL – AGND  
50% of VIDx  
50% of VIDx  
1.1  
1.3  
14.0  
14.4  
V
10.0  
10.4  
12.0  
12.4  
100  
22  
ns  
ns  
mA  
Ω
1 VDE = Differential Error Voltage = Common-Mode Error Voltage. See Theory of Operation section.  
2 VFS = 2 × (VREFHI – VREFLO).  
3 Maximum input transition time (10% to 90%) = 0.8/(2f) where f is the operating CLK rate.  
4 Measured from 50% of falling CLK edge to 50% of output change. Measurement is made for both states of INV.  
Rev. 0 | Page 3 of 16  
 
 
 
 
 
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