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AD6624AS/PCB

更新时间： 2024-01-12 04:42:20
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
40页 611K
描述
Four-Channel, 100 MSPS Digital Receive Signal Processor (RSP)

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AD6624AS/PCB 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：FQFP,针数：128
Reach Compliance Code：unknownECCN代码：5A991.B.1
HTS代码：8542.31.00.01风险等级：5.82
JESD-30 代码：R-PQFP-G128长度：20 mm
功能数量：1端子数量：128
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：FQFP
封装形状：RECTANGULAR封装形式：FLATPACK, FINE PITCH
认证状态：Not Qualified座面最大高度：3.4 mm
标称供电电压：2.5 V表面贴装：YES
技术：CMOS电信集成电路类型：TELECOM CIRCUIT
温度等级：INDUSTRIAL端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
宽度：14 mmBase Number Matches：1

AD6624AS/PCB 数据手册

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AD6624A  
TABLE OF CONTENTS  
FEATURES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1  
GENERAL DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . . . 1  
FUNCTIONAL BLOCK DIAGRAM . . . . . . . . . . . . . . . . . . . . 1  
SPECIFICATIONS/CHARACTERISTICS . . . . . . . . . . . . . . . . 3  
TIMING DIAGRAMS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6  
ABSOLUTE MAXIMUM RATINGS . . . . . . . . . . . . . . . . . . . . 9  
PIN FUNCTION DESCRIPTIONS . . . . . . . . . . . . . . . . . . . . 11  
ARCHITECTURE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13  
EXAMPLE FILTER RESPONSE . . . . . . . . . . . . . . . . . . . . . . 14  
INPUT DATA PORTS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14  
Input Data Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14  
Input Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14  
Input Enable Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14  
Gain Switching . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15  
Input Data Scaling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16  
Scaling with Fixed-Point ADCs . . . . . . . . . . . . . . . . . . . . . . . 16  
Scaling with Floating-Point or Gain-Ranging ADCs . . . . . . . 16  
NUMERICALLY CONTROLLED OSCILLATOR . . . . . . . . 17  
Frequency Translation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
NCO Frequency Hold-Off Register . . . . . . . . . . . . . . . . . . . . 17  
Phase Offset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
NCO Control Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
Bypass . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
Phase Dither . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
Amplitude Dither . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
Clear Phase Accumulator on HOP . . . . . . . . . . . . . . . . . . . . . 17  
Input Enable Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17  
Mode 00: Blank On IEN Low . . . . . . . . . . . . . . . . . . . . . . . . 17  
Mode 01: Clock On IEN High . . . . . . . . . . . . . . . . . . . . . . . 18  
Mode 10: Clock on IEN Transition to High . . . . . . . . . . . . . 18  
Mode 11: Clock on IEN Transition to Low . . . . . . . . . . . . . . 18  
WB Input Select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18  
Sync Select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18  
SECOND ORDER rCIC FILTER . . . . . . . . . . . . . . . . . . . . . . 18  
rCIC2 Rejection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19  
Example Calculations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19  
Decimation and Interpolation Registers . . . . . . . . . . . . . . . . . 19  
rCIC2 Scale . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19  
FIFTH ORDER CASCADED INTEGRATOR COMB  
FILTER . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20  
CIC5 Rejection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20  
RAM COEFFICIENT FILTER . . . . . . . . . . . . . . . . . . . . . . . . 20  
RCF Decimation Register . . . . . . . . . . . . . . . . . . . . . . . . . . . 21  
RCF Decimation Phase . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21  
RCF Filter Length . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21  
RCF Output Scale Factor and Control Register . . . . . . . . . . 21  
USER-CONFIGURABLE BUILT-IN SELF-TEST (BIST) . . 22  
RAM BIST . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22  
CHANNEL BIST . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22  
CHIP SYNCHRONIZATION . . . . . . . . . . . . . . . . . . . . . . . . . 22  
Start . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23  
Hop . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23  
SERIAL OUTPUT DATA PORT . . . . . . . . . . . . . . . . . . . . . . 24  
Serial Output Data Format . . . . . . . . . . . . . . . . . . . . . . . . . . 24  
Compact Serial Data Format . . . . . . . . . . . . . . . . . . . . . . . . . 24  
Serial Data Frame (Serial Bus Master) . . . . . . . . . . . . . . . . . . 24  
Serial Data Frame (Serial Cascade) . . . . . . . . . . . . . . . . . . . . 25  
Configuring the Serial Ports . . . . . . . . . . . . . . . . . . . . . . . . . . 25  
Serial Port Data Rate . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25  
Serial Port to DSP Interconnection . . . . . . . . . . . . . . . . . . . . 25  
Serial Slave Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26  
Serial Ports Cascaded . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26  
Serial Output Frame Timing (Master and Slave) . . . . . . . . . . 26  
Serial Port Timing Specifications . . . . . . . . . . . . . . . . . . . . . . 28  
SBM0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
SCLK . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
SDIN . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
SDO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
SDFS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
SDFE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
Serial Word Length . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
SDFS Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29  
Mapping RCF Data to the BIST Registers . . . . . . . . . . . . . . 30  
0x00–0x7F: Coefficient Memory (CMEM) . . . . . . . . . . . . . . 30  
0x80: Channel Sleep Register . . . . . . . . . . . . . . . . . . . . . . . . 30  
0x81: Soft_SYNC Register . . . . . . . . . . . . . . . . . . . . . . . . . . 30  
0x82: Pin_SYNC Register . . . . . . . . . . . . . . . . . . . . . . . . . . . 30  
0x83: Start Hold-Off Counter . . . . . . . . . . . . . . . . . . . . . . . . 30  
0x84: NCO Frequency Hold-Off Counter . . . . . . . . . . . . . . 30  
0x85: NCO Frequency Register 0 . . . . . . . . . . . . . . . . . . . . . 30  
0x86: NCO Frequency Register 1 . . . . . . . . . . . . . . . . . . . . . 30  
0x87: NCO Phase Offset Register . . . . . . . . . . . . . . . . . . . . . 30  
0x88: NCO Control Register . . . . . . . . . . . . . . . . . . . . . . . . . 30  
0x90: rCIC2 Decimation – 1 (MrCIC2–1) . . . . . . . . . . . . . . . . 31  
0x91: rCIC2 Interpolation – 1 (LrCIC2–1) . . . . . . . . . . . . . . . 31  
0x92: rCIC2 Scale . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31  
0x93: . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31  
0x94: CIC5 Decimation – 1 (MCIC5–1) . . . . . . . . . . . . . . . . . 31  
0x95: CIC5 Scale . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31  
0x96: . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31  
0xA0: RCF Decimation – 1 (MRCF–1) . . . . . . . . . . . . . . . . . . 31  
0xA1: RCF Decimation Phase (PRCF) . . . . . . . . . . . . . . . . . . 31  
0xA2: RCF Number of Taps Minus One (NRCF-1) . . . . . . . . 31  
0xA3: RCF Coefficient Offset (CORCF) . . . . . . . . . . . . . . . . . 31  
0xA4: RCF Control Register . . . . . . . . . . . . . . . . . . . . . . . . . 31  
0xA5: BIST Register for I . . . . . . . . . . . . . . . . . . . . . . . . . . . 32  
0xA6: BIST Register for Q . . . . . . . . . . . . . . . . . . . . . . . . . . 32  
0xA7: BIST Control Register . . . . . . . . . . . . . . . . . . . . . . . . 32  
0xA8: RAM BIST Control Register . . . . . . . . . . . . . . . . . . . 32  
0xA9: Serial Port Control Register . . . . . . . . . . . . . . . . . . . . 32  
MICROPORT CONTROL . . . . . . . . . . . . . . . . . . . . . . . . . . . 33  
External Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33  
Access Control Register (ACR) . . . . . . . . . . . . . . . . . . . . . . . 33  
External Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34  
Channel Address Register (CAR) . . . . . . . . . . . . . . . . . . . . . . 34  
SOFT_SYNC Control Register . . . . . . . . . . . . . . . . . . . . . . . 34  
PIN_SYNC Control Register . . . . . . . . . . . . . . . . . . . . . . . . . 34  
SLEEP Control Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34  
Data Address Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35  
Write Sequencing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35  
Read Sequencing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35  
Read/Write Chaining . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35  
Intel Nonmultiplexed Mode (INM) . . . . . . . . . . . . . . . . . . . . 35  
Motorola Nonmultiplexed Mode (MNM) . . . . . . . . . . . . . . . 35  
Input Port Control Registers . . . . . . . . . . . . . . . . . . . . . . . . . 35  
SERIAL PORT CONTROL . . . . . . . . . . . . . . . . . . . . . . . . . . . 36  
JTAG BOUNDARY SCAN . . . . . . . . . . . . . . . . . . . . . . . . . . . 36  
INTERNAL WRITE ACCESS . . . . . . . . . . . . . . . . . . . . . . . . . 37  
Write Pseudocode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37  
INTERNAL READ ACCESS . . . . . . . . . . . . . . . . . . . . . . . . . . 38  
Read Pseudocode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38  
OUTLINE DIMENSIONS . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39  
–2–  
REV. 0  
1234567...40

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与AD6624AS/PCB相关器件

型号 品牌 描述 获取价格 数据表
AD6624S/PCB ADI Four-Channel, 80 MSPS Digital Receive Signal Processor (RSP)

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