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AD5336BRUZ

更新时间： 2024-01-13 00:05:31
品牌 Logo 应用领域
亚德诺 - ADI 转换器数模转换器光电二极管
页数 文件大小 规格书
20页 384K
描述
2.5 V to 5.5 V, 500 A, Parallel Interface Quad Voltage-Output 8-/10-/12-Bit DACs

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AD5336BRUZ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP-28针数：24
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.44
最大模拟输出电压：2.999 V最小模拟输出电压：0.001 V
转换器类型：D/A CONVERTER输入位码：BINARY
输入格式：PARALLEL, 8 BITSJESD-30 代码：R-PDSO-G24
JESD-609代码：e3长度：9.7 mm
最大线性误差 (EL)：0.3906%湿度敏感等级：1
位数：10功能数量：4
端子数量：24最高工作温度：105 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP28,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：2.5/5.5 V
认证状态：Not Qualified座面最大高度：1.2 mm
最大稳定时间：9 µs标称安定时间 (tstl)：7 µs
子类别：Other Converters最大压摆率：0.9 mA
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：4.4 mm

AD5336BRUZ 数据手册

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AD5334/AD5335/AD5336/AD5344  
AD5336 PIN CONFIGURATION  
AD5336 FUNCTIONAL BLOCK DIAGRAM  
V
A
V
B
V
DD  
REF  
REF  
V
V
V
V
V
D
C
B
A
A
B
1
2
28  
27  
26  
25  
24  
23  
22  
21  
20  
CLR  
REF  
REF  
REF  
REF  
POWER-ON  
RESET  
GAIN  
AD5336  
3
DB  
DB  
DB  
9
8
7
GAIN  
4
DAC  
INPUT  
REGISTER  
DB  
9
10-BIT  
DAC  
.
.
.
BUFFER  
V
V
A
B
REGISTER  
5
OUT  
OUT  
10-BIT  
DB  
6
V
DB  
DB  
DB  
DB  
0
OUT  
OUT  
OUT  
6
5
AD5336  
TOP VIEW  
(Not to Scale)  
7
V
V
C
D
CS  
WR  
A0  
DAC  
REGISTER  
INPUT  
REGISTER  
8
10-BIT  
DAC  
4
BUFFER  
OUT  
GND  
9
3
INTER-  
FACE  
LOGIC  
10  
11  
12  
13  
14  
19 DB  
18 DB  
17 DB  
CS  
WR  
A0  
2
1
DAC  
INPUT  
10-BIT  
DAC  
A1  
BUFFER  
BUFFER  
0
V
V
C
D
REGISTER  
OUT  
REGISTER  
A1  
16  
15  
V
DD  
LDAC  
PD  
DAC  
REGISTER  
INPUT  
REGISTER  
10-BIT  
DAC  
OUT  
TO ALL DACS  
AND BUFFERS  
CLR  
RESET  
LDAC  
POWER-DOWN  
LOGIC  
V
D
V
C
GND  
PD  
REF  
REF  
AD5336 PIN FUNCTION DESCRIPTIONS  
Pin  
No.  
Mnemonic  
VREF  
Function  
1
D
Unbuffered Reference Input for DAC D.  
2
3
4
5
6
7
8
9
10  
11  
12  
13  
14  
V
V
V
V
V
V
V
REFC  
REFB  
REFA  
OUTA  
OUTB  
OUTC  
OUTD  
Unbuffered Reference Input for DAC C.  
Unbuffered Reference Input for DAC B.  
Unbuffered Reference Input for DAC A.  
Output of DAC A. Buffered output with rail-to-rail operation.  
Output of DAC B. Buffered output with rail-to-rail operation.  
Output of DAC C. Buffered output with rail-to-rail operation.  
Output of DAC D. Buffered output with rail-to-rail operation.  
Ground Reference Point for All Circuitry on the Part.  
Active Low Chip Select Input. This is used in conjunction with WR to write data to the parallel interface.  
Active Low Write Input. This is used in conjunction with CS to write data to the parallel interface.  
LSB Address Pin for Selecting which DAC Is to Be Written to.  
GND  
CS  
WR  
A0  
A1  
MSB Address Pin for Selecting which DAC is to Be Written to.  
Active Low Control Input that Updates the DAC Registers with the Contents of the Input Registers.  
This allows all DAC outputs to be simultaneously updated.  
LDAC  
15  
16  
PD  
Power-Down Pin. This active low control pin puts all DACs into power-down mode.  
Power Supply Pin. This part can operate from 2.5 V to 5.5 V and the supply should be decoupled with a  
VDD  
10 µF capacitor in parallel with a 0.1 µF capacitor to GND.  
17–26  
27  
DB0–DB9  
GAIN  
10 Parallel Data Inputs. DB9 is the MSB of these 10 bits.  
Gain Control Pin. This controls whether the output range from the DAC is 0–VREF or 0–2 VREF  
.
28  
CLR  
Asynchronous Active Low Control Input that Clears All Input Registers and DAC Registers to Zeros.  
–7–  
REV. 0  
1...45678910...20

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与AD5336BRUZ相关器件

型号 品牌 描述 获取价格 数据表
AD5336BRUZ-REEL7 ROCHESTER QUAD, PARALLEL, 8 BITS INPUT LOADING, 7us SETTLING TIME, 10-BIT DAC, PDSO24, TSSOP-28

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