Datasheet > 转换器 > 数模转换器> AD5321BRTZ-REEL

AD5321BRTZ-REEL

更新时间： 2024-02-22 06:54:35

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亚德诺 - ADI		/
页数	文件大小	规格书
24页	565K
描述
SERIAL INPUT LOADING, 8us SETTLING TIME, 12-BIT DAC, PDSO6, ROHS COMPLIANT, MO-178AB, SOT-23, 6 PIN

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AD5321BRTZ-REEL 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	LSSOP, TSOP6,.11,37	针数：	6
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.36
最大模拟输出电压：	5.499 V	最小模拟输出电压：	0.001 V
转换器类型：	D/A CONVERTER	输入位码：	BINARY
输入格式：	SERIAL	JESD-30 代码：	R-PDSO-G6
JESD-609代码：	e4	长度：	2.9 mm
最大线性误差 (EL)：	0.3906%	湿度敏感等级：	1
位数：	12	功能数量：	1
端子数量：	6	最高工作温度：	105 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	LSSOP	封装等效代码：	TSOP6,.11,37
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, LOW PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3/5 V
认证状态：	Not Qualified	座面最大高度：	1.45 mm
最大稳定时间：	10 µs	标称安定时间 (tstl)：	8 µs
子类别：	Other Converters	最大压摆率：	0.225 mA
标称供电电压：	3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)	端子形式：	GULL WING
端子节距：	0.95 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	1.6 mm
Base Number Matches：	1

AD5321BRTZ-REEL 数据手册

AD5305/AD5315/AD5325

When both bits are set to 0, the DAC works normally with its

normal power consumption of 600 μA at 5 V. However, for the

three power-down modes, the supply current falls to 200 nA at

5 V (80 nA at 3 V). Not only does the supply current drop, but

the output stage is also internally switched from the output of

the amplifier to a resistor network of known values. This has an

advantageous because the output impedance of the part is known

while the part is in power-down mode and provides a defined

input condition for whatever is connected to the output of the

DAC amplifier. There are three different options. The output is

connected internally to GND through a 1 kΩ resistor, a 100 kΩ

resistor, or it is left open-circuited (three-state). Resistor

RESISTOR

STRING DAC

AMPLIFIER

OUT

POWER-DOWN

CIRCUITRY

RESISTOR

NETWORK

Figure 35. Output Stage During Power-Down

The bias generator, the output amplifiers, the resistor string, and

all other associated linear circuitry are shut down when the

power-down mode is activated. However, the contents of the

DAC registers are unchanged when in power-down. The time to

exit power-down is typically 2.5 μs for V_DD= 5 V and 5 μs when

tolerance = 20ꢁ. The output stage is illustrated in Figure 35.

V_DD= 3 V. This is the time from the rising edge of the eighth

SCL pulse to when the output voltage deviates from its power-

down voltage. See Figure 21 for a plot.

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AD5321BRTZ-REEL71	ADI	获取价格	2.5 V to 5.5 V, 120 Î¼A, 2-Wire Interface, Vo
AD5322	ADI	获取价格	+2.5 V to +5.5 V, 230 uA Dual Rail-to-Rail, Voltage Output 8-/10-/12-Bit DACs
AD5322ARM	ADI	获取价格	2.5 V to 5.5 V, 230 Î¼A, Dual Rail-to-Rail, V
AD5322ARM	ROCHESTER	获取价格	SERIAL INPUT LOADING, 8 us SETTLING TIME, 12-BIT DAC, PDSO10, MO-187BA, MSOP-10
AD5322ARM-REEL7	ADI	获取价格	2.5 V to 5.5 V, 230 Î¼A, Dual Rail-to-Rail, V
AD5322ARM-REEL7	ROCHESTER	获取价格	SERIAL INPUT LOADING, 8 us SETTLING TIME, 12-BIT DAC, PDSO10, MO-187BA, MSOP-10
AD5322ARMZ	ADI	获取价格	2.5 V to 5.5 V, 230 Î¼A, Dual Rail-to-Rail, V
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