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A62L256M-55LLU

更新时间： 2022-11-26 01:20:16

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联笙电子 - AMICC		静态存储器
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14页	148K
描述
32K X 8 BIT LOW VOLTAGE CMOS SRAM

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A62L256M-55LLU 数据手册

A62L256 Series

AC Test Conditions

Input Pulse Levels

0V, VCC

5 ns

Input Rise And Fall Time

Input and Output Timing Reference Levels

Output Load

VCC/2

See Figure 1

30pF

* Including scope and jig.

Figure 1. Output Load

Data Retention Characteristics (TA = 0°C to 70°C or -40ºC to +85ºC)

Symbol

Parameter

VCC for Data Retention

Min.

Typ.

Max.

Unit

Conditions

VDR

2.0

3.6

CE ³ VCC - 0.2V

VCC = 2V,

LL-version

0.02

0.5

ICCDR

Data Retention Current

CE ³ VCC - 0.2V

VIN ³ 0V

LLU-version

tCDR

Chip Disable to Data Retention Time

Operation Recovery Time

See Retention Waveform

tRC

Typical values are measured at TA = 25°C.

Low VCC Data Retention Waveform

DATA RETENTION MODE

3.0V

VCC

tCDR

VCC ³ 2.0V

VIH

CE ³ VCC - 0.2V

PRELIMINARY

(November, 2001, Version 1.4)

AMIC Technology, Inc.

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