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A43E16161G-75UF

更新时间： 2024-01-15 22:26:47
品牌 Logo 应用领域
联笙电子 - AMICC 时钟动态存储器内存集成电路
页数 文件大小 规格书
48页 557K
描述
Synchronous DRAM, 2MX16, 6ns, CMOS, PBGA54

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A43E16161G-75UF 技术参数

是否Rohs认证： 符合生命周期：Contact Manufacturer
包装说明：FBGA, BGA54,9X9,32Reach Compliance Code：unknown
风险等级：5.75最长访问时间：6 ns
最大时钟频率 (fCLK)：133 MHzI/O 类型：COMMON
交错的突发长度：1,2,4,8JESD-30 代码：S-PBGA-B54
内存密度：33554432 bit内存集成电路类型：SYNCHRONOUS DRAM
内存宽度：16端子数量：54
字数：2097152 words字数代码：2000000
最高工作温度：85 °C最低工作温度：-40 °C
组织：2MX16输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：FBGA
封装等效代码：BGA54,9X9,32封装形状：SQUARE
封装形式：GRID ARRAY, FINE PITCH电源：1.8 V
认证状态：Not Qualified刷新周期：4096
连续突发长度：1,2,4,8,FP最大待机电流：0.00001 A
子类别：DRAMs最大压摆率：0.06 mA
标称供电电压 (Vsup)：1.8 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：BALL端子节距：0.8 mm
端子位置：BOTTOMBase Number Matches：1

A43E16161G-75UF 数据手册

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A43E16161  
Function Truth Table for CKE (Table 2)  
Current  
State  
CKE CKE  
CS  
RAS  
Address  
Action  
Note  
CAS  
WE  
n-1  
n
H
X
X
H
L
X
X
H
H
H
L
X
X
H
H
L
X
X
H
L
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
INVALID  
L
L
H
H
H
H
H
L
6
6
Exit Self Refresh→ABI after tRC  
Exit Self Refresh→ABI after tRC  
ILLEGAL  
Self  
L
L
Refresh  
L
L
X
X
X
X
X
H
L
ILLEGAL  
L
L
X
X
X
X
H
H
L
ILLEGAL  
L
X
X
H
L
X
X
X
H
H
H
L
NOP(Maintain Self Refresh)  
INVALID  
H
L
X
H
H
H
H
H
L
7
7
Exit Power Down→ABI  
Exit Power Down→ABI  
ILLEGAL  
Both  
Bank  
Precharge  
Power  
L
L
L
L
L
X
X
X
X
X
H
L
ILLEGAL  
Down  
L
L
X
X
X
X
H
H
L
ILLEGAL  
L
X
X
H
L
X
X
X
H
H
H
L
NOP(Maintain Power Down Mode)  
Refer to Table 1  
H
H
H
H
H
H
H
H
L
H
L
Enter Power Down  
Enter Power Down  
ILLEGAL  
8
8
L
All  
Banks  
Idle  
L
L
L
L
X
X
H
L
ILLEGAL  
L
L
H
L
ILLEGAL  
L
L
L
Enter Self Refresh  
ILLEGAL  
8
L
L
L
L
L
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
X
NOP  
H
H
L
H
L
Refer to Operations in Table 1  
Begin Clock Suspend next cycle  
Exit Clock Suspend next cycle  
Maintain clock Suspend  
Any State  
Other than  
Listed  
9
9
H
L
Above  
L
Abbreviations : ABI = All Banks Idle  
Note: 6. After CKE’s low to high transition to exit self refresh mode. And a time of tRC(min) has to be elapse after CKE’s low to  
high transition to issue a new command.  
7. CKE low to high transition is asynchronous as if restarts internal clock.  
A minimum setup time “tSS + one clock” must be satisfied before any command other than exit.  
8. Power-down and self refresh can be entered only from the all banks idle state.  
9. Must be a legal command.  
PRELIMINARY (February, 2008, Version 0.3)  
43  
AMIC Technology, Corp.  
1...4142434445464748

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