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810251AGILF

更新时间： 2024-01-03 15:29:56
品牌 Logo 应用领域
艾迪悌 - IDT 时钟光电二极管外围集成电路石英晶振压控振荡器晶体
页数 文件大小 规格书
15页 238K
描述
VCXO and Synchronous Ethernet Jit ter At tenuator

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810251AGILF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP-16针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：7.9
其他特性：ALSO OPERATES AT 3.3V SUPPLYJESD-30 代码：R-PDSO-G16
JESD-609代码：e3长度：5 mm
湿度敏感等级：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
最大输出时钟频率：25 MHz封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：2.5/3.3 V
主时钟/晶体标称频率：25 MHz认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Clock Generators
最大压摆率：40 mA最大供电电压：2.625 V
最小供电电压：2.375 V标称供电电压：2.5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn) - annealed
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER
Base Number Matches：1

810251AGILF 数据手册

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810251I Data Sheet  
Table 3C. LVCMOS/LVTTL DC Characteristics, VDD = VDDO = 3.3V 5% or 2.5V 5%, TA = -40°C to 85°C  
Symbol Parameter  
Test Conditions  
VDD = 3.465V  
Minimum  
Typical  
Maximum  
VDD + 0.3  
VDD + 0.3  
0.8  
Units  
V
2
Input  
VIH  
High Voltage  
VDD = 2.625V  
1.7  
-0.3  
-0.3  
V
VDD = 3.465V  
V
Input  
VIL  
Low Voltage  
VDD = 2.625V  
0.7  
V
CLK_IN  
VDD = VIN = 3.465V or 2.625V  
150  
µA  
µA  
µA  
µA  
V
Input  
IIH  
High Current  
OE, PLL_SEL  
CLK_IN  
V
DD = VIN = 3.465V or 2.625V  
5
VDD = 3.465V or 2.625V, VIN = 0V  
VDD = 3.465V or 2.625V, VIN = 0V  
VDDO = 3.3V 5%  
-5  
-150  
2.6  
Input  
IIL  
Low Current  
OE, PLL_SEL  
VOH  
Output High Voltage; NOTE 1  
Output Low Voltage; NOTE 1  
VDDO = 2.5V 5%  
1.8  
V
VDDO = 3.3V 5%  
0.6  
0.5  
V
VOL  
VDDO = 2.5V 5%  
V
NOTE 1: Outputs terminated with 50to VDDO/2. See Parameter Measurement Information section. Load Test Circuit diagrams.  
AC Electrical Characteristics  
Table 4A. AC Characteristics, VDD = VDDO = 3.3V 5%, TA = -40°C to 85°C  
Symbol  
Parameter  
Test Conditions  
Minimum  
Typical  
25  
Maximum  
Units  
MHz  
MHz  
MHz  
MHz  
ps  
fREF  
Input Reference Frequency  
125  
25  
fVCO  
VCXO-PLL Frequency  
Output Frequency  
fOUT  
25  
tJIT(CC)  
Cycle-to-Cycle Jitter; NOTE 1  
45  
RMS Phase Jitter (Random);  
NOTE 2  
f
OUT = 25MHz, Integration Range:  
1kHz – 1MHz  
tjit()  
0.22  
ps  
tJIT(PER)  
tR / tF  
odc  
Period jitter  
5
1200  
52  
ps  
ps  
%
%
Output Rise/Fall Time  
Output Duty Cycle; NOTE 3  
Output Duty Cycle; NOTE 4  
20% to 80%  
500  
48  
odc  
45  
55  
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when device is  
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. Device will meet specifications after thermal equilibrium has  
been reached under these conditions.  
NOTE: Characterized using a 616Hz bandwidth filter.  
NOTE 1: This parameter is defined in accordance with JEDEC Standard 65.  
NOTE 2: Please refer to the Phase Noise Plot.  
NOTE 3: Specified with the VCXO-PLL free running high.  
NOTE 4: Specified with the VCXO-PLL locked.  
©2016 Integrated Device Technology, Inc  
4
Revision B March 3, 2016  
1234567...15

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