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80C52-12

更新时间： 2024-02-02 04:54:34

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CMOS 0 to 44 MHz Single Chip 8?bit Microntroller

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80C52-12 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	QCCJ,	针数：	44
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.2.C
HTS代码：	8542.31.00.01	风险等级：	5.78
Is Samacsys：	N	具有ADC：	NO
地址总线宽度：	16	位大小：	8
最大时钟频率：	12 MHz	DAC 通道：	NO
DMA 通道：	NO	外部数据总线宽度：	8
JESD-30 代码：	S-CQCC-J44	JESD-609代码：	e3
长度：	16.4465 mm	I/O 线路数量：	32
端子数量：	44	最高工作温度：	125 °C
最低工作温度：	-55 °C	PWM 通道：	NO
封装主体材料：	CERAMIC, METAL-SEALED COFIRED	封装代码：	QCCJ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
认证状态：	Not Qualified	ROM可编程性：	MROM
座面最大高度：	4.83 mm	速度：	12 MHz
最大压摆率：	35 mA	最大供电电压：	5.5 V
最小供电电压：	4.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子面层：	TIN	端子形式：	J BEND
端子节距：	1.27 mm	端子位置：	QUAD
宽度：	16.4465 mm	uPs/uCs/外围集成电路类型：	MICROCONTROLLER
Base Number Matches：	1

80C52-12 数据手册

80C32/80C52

Note 1 : ICC is measured with all output pins

disconnected ; XTAL1 driven with TCLCH, TCHCL =

5 ns, VIL = VSS + .5 V, VIH = VCC –.5 V ; XTAL2

N.C. ; EA = RST = Port 0 = VCC. ICC would be slighty

higher if a crystal oscillator used.

Figure 9. ICC Test Condition, Idle Mode.

All other pins are disconnected.

Idle ICC is measured with all output pins disconnected ;

XTAL1 driven with TCLCH, TCHCL = 5 ns, VIL =

VSS + 5 V, VIH = VCC –.5 V ; XTAL2 N.C ; Port 0 =

VCC ; EA = RST = VSS.

Power Down ICC is measured with all output pins

disconnected ; EA = PORT 0 = VCC ; XTAL2 N.C. ;

RST = VSS.

Note 2 : Capacitance loading on Ports 0 and 2 may cause

spurious noise pulses to be superimposed on the VOLS of

ALE and Ports 1 and 3. The noise is due to external bus

capacitance discharging into the Port 0 and Port 2 pins

when these pins make 1 to 0 transitions during bus

operations. In the worst cases (capacitive loading 100

pF), the noise pulse on the ALE line may exceed 0.45 V

may exceed 0,45 V with maxi VOL peak 0.6 V. A Schmitt

Trigger use is not necessary.

Figure 10. ICC Test Condition, Active Mode.

All other pins are disconnected.

Figure 11. ICC Test Condition, Power Down Mode.

All other pins are disconnected.

Figure 12. Clock Signal Waveform for ICC Tests in Active and Idle Modes. TCLCH = TCHCL = 5 ns.

MATRA MHS

Rev. G (14 Jan. 97)

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