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74LVC138AD/T3

更新时间： 2024-02-09 08:54:19
品牌 Logo 应用领域
恩智浦 - NXP 驱动光电二极管输出元件逻辑集成电路
页数 文件大小 规格书
20页 106K
描述
IC LVC/LCX/Z SERIES, OTHER DECODER/DRIVER, INVERTED OUTPUT, PDSO16, 3.90 MM, PLASTIC, MS-012, SOT-109-1, SOP-16, Decoder/Driver

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74LVC138AD/T3 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP,针数：16
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.03
系列：LVC/LCX/Z输入调节：STANDARD
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：9.9 mm逻辑集成电路类型：OTHER DECODER/DRIVER
湿度敏感等级：1功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-40 °C输出极性：INVERTED
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260传播延迟（tpd）：8.5 ns
认证状态：Not Qualified座面最大高度：1.75 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：1.2 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：NICKEL PALLADIUM GOLD端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：3.9 mm
Base Number Matches：1

74LVC138AD/T3 数据手册

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Philips Semiconductors  
Product specification  
3-to-8 line decoder/demultiplexer; inverting  
74LVC138A  
FEATURES  
DESCRIPTION  
The 74LVC138A is a high-performance, low-power,  
low-voltage, Si-gate CMOS device, superior to most  
advanced CMOS compatible TTL families.  
• 5 V tolerant inputs for interfacing with 5 V logic  
• Wide supply voltage range from 1.2 to 3.6 V  
• CMOS low power consumption  
The 74LVC138A accepts three binary weighted address  
inputs (A0, A1 and A2) and when enabled, provides 8  
mutually exclusive active LOW outputs (Y0 to Y7).  
• Direct interface with TTL levels  
• Inputs accept voltages up to 5.5 V  
• Demultiplexing capability  
The 74LVC138A features three enable inputs: two active  
LOW (E1 and E2) and one active HIGH (E3). Every output  
will be HIGH unless E1 and E2 are LOW and E3 is HIGH.  
• Multiple input enable for easy expansion  
• Ideal for memory chip select decoding  
• Active LOW mutually exclusive outputs  
This multiple enable function allows easy parallel  
expansion of the 74LVC138A to a 1-of-32 (5 to 32 lines)  
decoder with just four 74LVC138A ICs and one inverter.  
The 74LVC138A can be used as an eight output  
demultiplexer by using one of the active LOW enable  
inputs as the data input and the remaining enable inputs as  
strobes. Unused enable inputs must be permanently tied  
to their appropriate active HIGH or LOW state.  
• Output drive capability 50 Ω transmission lines at  
125 °C  
• Complies with JEDEC standard no. 8-1A  
• ESD protection:  
HBM EIA/JESD22-A114-A exceeds 2000 V  
MM EIA/JESD22-A115-A exceeds 200 V.  
• Specified from −40 to +85 °C and −40 to +125 °C.  
QUICK REFERENCE DATA  
GND = 0 V; Tamb = 25 °C; tr = tf ≤ 2.5 ns.  
SYMBOL  
PARAMETER  
CONDITIONS  
CL = 50 pF; VCC = 3.3 V  
CL = 50 pF; VCC = 3.3 V  
CL = 50 pF; VCC = 3.3 V  
TYPICAL  
2.6  
UNIT  
t
PHL/tPLH  
propagation delay An to Yn  
propagation delay E3 to Yn  
propagation delay En to Yn  
input capacitance  
ns  
ns  
ns  
pF  
pF  
2.8  
2.7  
4.0  
21  
CI  
CPD  
power dissipation capacitance per gate  
VCC = 3.3 V; notes 1 and 2  
Notes  
1. CPD is used to determine the dynamic power dissipation (PD in µW).  
PD = CPD × VCC2 × fi × N + Σ(CL × VCC2 × fo) where:  
fi = input frequency in MHz;  
fo = output frequency in MHz;  
CL = output load capacitance in pF;  
VCC = supply voltage in Volts;  
N = total switching outputs;  
Σ(CL × VCC2 × fo) = sum of the outputs.  
2. The condition is VI = GND to VCC  
.
2003 May 06  
2
1234567...20

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