5秒后页面跳转
捷配首页

Datasheet > 逻辑 > 移位寄存器> 74LS194AFC
74LS194AFC PDF预览

74LS194AFC

更新时间： 2024-11-18 12:59:47
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 移位寄存器
页数 文件大小 规格书
6页 71K
描述
Shift Register, 4-Bit, TTL, CDFP16,

阅读下载

中文翻译

获取价格

74LS194AFC 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：ObsoleteReach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.85
Is Samacsys：NJESD-30 代码：R-XDFP-F16
JESD-609代码：e0位数：4
功能数量：1端子数量：16
最高工作温度：70 °C最低工作温度：
封装主体材料：CERAMIC封装代码：DFP
封装等效代码：FL16,.3封装形状：RECTANGULAR
封装形式：FLATPACK峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V认证状态：Not Qualified
子类别：Shift Registers标称供电电压 (Vsup)：5 V
表面贴装：YES技术：TTL
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：FLAT端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
Base Number Matches：1

74LS194AFC 数据手册

 浏览型号74LS194AFC的Datasheet PDF文件第2页浏览型号74LS194AFC的Datasheet PDF文件第3页浏览型号74LS194AFC的Datasheet PDF文件第4页浏览型号74LS194AFC的Datasheet PDF文件第5页浏览型号74LS194AFC的Datasheet PDF文件第6页 
August 1986  
Revised March 2000  
DM74LS194A  
4-Bit Bidirectional Universal Shift Register  
General Description  
Features  
This bidirectional shift register is designed to incorporate  
virtually all of the features a system designer may want in a  
shift register; they feature parallel inputs, parallel outputs,  
right-shift and left-shift serial inputs, operating-mode-con-  
trol inputs, and a direct overriding clear line. The register  
has four distinct modes of operation, namely:  
■ Parallel inputs and outputs  
■ Four operating modes:  
Synchronous parallel load  
Right shift  
Left shift  
Do nothing  
Parallel (broadside) load  
■ Positive edge-triggered clocking  
■ Direct overriding clear  
Shift right (in the direction QA toward QD)  
Shift left (in the direction QD toward QA)  
Inhibit clock (do nothing)  
Synchronous parallel loading is accomplished by applying  
the four bits of data and taking both mode control inputs,  
S0 and S1, HIGH. The data is loaded into the associated  
flip-flops and appear at the outputs after the positive transi-  
tion of the clock input. During loading, serial data flow is  
inhibited.  
Shift right is accomplished synchronously with the rising  
edge of the clock pulse when S0 is HIGH and S1 is LOW.  
Serial data for this mode is entered at the shift-right data  
input. When S0 is LOW and S1 is HIGH, data shifts left  
synchronously and new data is entered at the shift-left  
serial input.  
Clocking of the flip-flop is inhibited when both mode control  
inputs are LOW.  
Ordering Code:  
Order Number Package Number  
Package Description  
DM74LS194AM  
DM74LS194AN  
M16A  
N16E  
16-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150 Narrow  
16-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide  
Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.  
Connection Diagram  
© 2000 Fairchild Semiconductor Corporation  
DS006407  
www.fairchildsemi.com  
123456

中文翻译

下载PDF

与74LS194AFC相关器件

型号 品牌 获取价格 描述 数据表
74LS194AFCQM FAIRCHILD

获取价格

 		Shift Register, 4-Bit, TTL, CDFP16,
74LS194AFCQR ROCHESTER

获取价格

 		Parallel In Parallel Out
74LS195 ONSEMI

获取价格

 		LOW POWER SCHOTTKY
74LS195 HITACHI

获取价格

 		4-bit Parallel-Access Shift Registers
74LS195 TI

获取价格

 		4-BIT PARALLEL-ACCESS SHIFT REGISTERS
74LS195 MOTOROLA

获取价格

 		UNIVERSAL 4-BIT SHIFT REGISTER
74LS195A NSC

获取价格

 		UNIVERSAL 4-BIT SHIFT REGISTER
74LS195ADC NSC

获取价格

 		UNIVERSAL 4-BIT SHIFT REGISTER
74LS195ADCQM FAIRCHILD

获取价格

 		Shift Register, 4-Bit, TTL, CDIP16,
74LS195ADCQR FAIRCHILD

获取价格

 		Shift Register, 4-Bit, TTL, CDIP16,

与74LS194AFC相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证