74HCT564D

更新时间： 2024-01-16 21:38:29

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恩智浦 - NXP		触发器逻辑集成电路
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7页	62K
描述
Octal D-type flip-flop; positive-edge trigger; 3-state; inverting

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74HCT564D 技术参数

生命周期：	Obsolete	包装说明：	DIP,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.54	其他特性：	BROADSIDE VERSION OF 534
系列：	HCT	JESD-30 代码：	R-PDIP-T20
长度：	26.73 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	BUS DRIVER	位数：	8
功能数量：	1	端口数量：	2
端子数量：	20	最高工作温度：	125 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	INVERTED	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	传播延迟（tpd）：	53 ns
认证状态：	Not Qualified	座面最大高度：	4.2 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	AUTOMOTIVE
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	宽度：	7.62 mm
Base Number Matches：	1

74HCT564D 数据手册

Philips Semiconductors

Product speciﬁcation

Octal D-type ﬂip-ﬂop; positive-edge

trigger; 3-state; inverting

74HC/HCT564

The 74HC/HCT564 are octal D-type flip-flops featuring

separate D-type inputs for each flip-flop and inverting

3-state outputs for bus oriented applications. A clock (CP)

and an output enable (OE) input are common to all

flip-flops.

FEATURES

• 3-state inverting outputs for bus oriented applications

• 8-bit positive-edge triggered register

• Common 3-state output enable input

• Independent register and 3-state buffer operation

• Output capability: bus driver

The 8 flip-flops will store the state of their individual

D-inputs that meet the set-up and hold times requirements

on the LOW-to-HIGH CP transition.

When OE is LOW, the contents of the 8 flip-flops are

available at the outputs.

• I_CCcategory: MSI

When OE is HIGH, the outputs go to the high impedance

OFF-state. Operation of the OE input does not affect the

state of the flip-flops.

GENERAL DESCRIPTION

The 74HC/HCT564 are high-speed Si-gate CMOS devices

and are pin compatible with low power Schottky TTL

(LSTTL). They are specified in compliance with JEDEC

standard no. 7A.

The “564” is functionally identical to the “574” but has

inverting outputs. The “564” is functionally identical to the

“534”, but has a different pinning.

QUICK REFERENCE DATA

GND = 0 V; T_amb= 25 °C; t_r= t_f= 6 ns

TYPICAL

SYMBOL

PARAMETER

CONDITIONS

UNIT

C_L= 15 pF; V_CC= 5 V 15

127

HCT

t_PHL/t_PLH

f_max

propagation delay CP to Q_n

maximum clock frequency

input capacitance

3.5

MHz

C_I

3.5

C_PD

power dissipation capacitance per flip-flop

notes 1 and 2

Notes

1. C_PDis used to determine the dynamic power dissipation (P_Din µW):

P_D= C_PD× V_CC²× f_i+∑ (C_L× V_CC× f_o) where:

f_i= input frequency in MHz

f_o= output frequency in MHz

∑ (C_L× V_CC²× f_o) = sum of outputs

C_L= output load capacitance in pF

V_CC= supply voltage in V

2. For HC the condition is V_I= GND to V_CC; for HCT the condition is V_I= GND to V_CC− 1.5 V

ORDERING INFORMATION

See “74HC/HCT/HCU/HCMOS Logic Package Information”.

December 1990

123 4 5 6 7

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型号	品牌	描述	获取价格	数据表
74HCT564DB-T	NXP	IC HCT SERIES, 8-BIT DRIVER, INVERTED OUTPUT, PDSO20, Bus Driver/Transceiver	获取价格
74HCT564D-T	ETC	Octal D-Type Flip-Flop	获取价格
74HCT564N	NXP	Octal D-type flip-flop; positive-edge trigger; 3-state; inverting	获取价格
74HCT564NB	NXP	IC HCT SERIES, 8-BIT DRIVER, INVERTED OUTPUT, PDIP20, Bus Driver/Transceiver	获取价格
74HCT564P	SUPERTEX	Bus Driver, 8-Func, CMOS, PDIP20	获取价格
74HCT573	NXP	Octal D-type transparent latch; 3-state	获取价格

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