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74HCT4017DB

更新时间： 2024-01-29 10:17:07
品牌 Logo 应用领域
恩智浦 - NXP 计数器
页数 文件大小 规格书
12页 90K
描述
IC HCT SERIES, SYN POSITIVE EDGE TRIGGERED 10-BIT UP RING COUNTER, PDSO16, Counter

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74HCT4017DB 技术参数

生命周期：Obsolete包装说明：TSSOP,
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.62其他特性：JOHNSON COUNTER WITH 10 DECODED OUTPUTS
计数方向：UP系列：HCT
JESD-30 代码：R-PDSO-G16长度：5 mm
负载电容（CL）：50 pF负载/预设输入：YES
逻辑集成电路类型：RING COUNTER工作模式：SYNCHRONOUS
位数：10功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH传播延迟（tpd）：75 ns
认证状态：Not Qualified座面最大高度：1.1 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
宽度：4.4 mm最小 fmax：20 MHz
Base Number Matches：1

74HCT4017DB 数据手册

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Philips Semiconductors  
Product specification  
Johnson decade counter with 10 decoded outputs  
74HC/HCT4017  
AC CHARACTERISTICS FOR 74HCT  
GND = 0 V; tr = tf = 6 ns; CL = 50 pF  
Tamb (°C)  
TEST CONDITIONS  
74HCT  
SYMBOL  
PARAMETER  
UNIT  
WAVEFORMS  
VCC  
(V)  
+25  
−40 to+85  
−40 to+125  
min. typ. max. min.  
max.  
min.  
max.  
tPHL/ tPLH  
propagation delay  
CP0 to Qn  
25  
25  
25  
25  
22  
20  
7
46  
46  
50  
50  
46  
46  
15  
58  
69  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
4.5  
4.5  
4.5  
4.5  
4.5  
4.5  
4.5  
4.5  
4.5  
4.5  
4.5  
Fig.9  
Fig.9  
Fig.9  
Fig.9  
Fig.8  
Fig.8  
Fig.9  
Fig.8  
Fig.8  
Fig.8  
Fig.7  
t
t
PHL/ tPLH  
PHL/ tPLH  
propagation delay  
CP0 to Q5-9  
58  
63  
63  
58  
58  
19  
69  
75  
75  
69  
69  
22  
propagation delay  
CP1 to Qn  
tPHL/ tPLH  
tPHL  
propagation delay  
CP1 to Q5-9  
propagation delay  
MR to Q1−9  
tPLH  
propagation delay  
MR to Q5−9, Q0  
t
THL/ tTLH  
output transition time  
tW  
clock pulse width  
HIGH or LOW  
16  
16  
5
7
20  
20  
5
24  
tW  
master reset pulse  
width; HIGH  
4
24  
5
trem  
tsu  
removal time  
MR to CP0, CP1  
−5  
−3  
set-up time  
CP1 to CP0;  
CP0 to CP1  
10  
13  
15  
th  
hold time  
CP0 to CP1;  
CP1 to CP0  
10  
6
13  
24  
15  
20  
ns  
ns  
4.5  
4.5  
Fig.7  
Fig.8  
fmax  
maximum clock pulse 30  
frequency  
61  
December 1990  
9
1...6789101112

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