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74HCT32BQ-Q100,115

更新时间： 2024-02-28 15:53:14

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恩智浦 - NXP		/
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15页	129K
描述
74HC(T)32-Q100 - Quad 2-input OR gate QFN 14-Pin

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74HCT32BQ-Q100,115 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	QFN	包装说明：	2.50 X 3 MM, 0.85 MM HEIGHT, PLASTIC, MO-241, SOT762-1, DHVQFN-14
针数：	14	Reach Compliance Code：	compliant
风险等级：	5.76	Base Number Matches：	1

74HCT32BQ-Q100,115 数据手册

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74HC32-Q100; 74HCT32-Q100

NXP Semiconductors

Quad 2-input OR gate

Table 7.

Dynamic characteristics

GND = 0 V; C_L= 50 pF; for load circuit see Figure 7.

Symbol Parameter

Conditions

25 C

40 C to +125 C Unit

Max Max

(85 C) (125 C)

Min

Typ

Max

74HCT32-Q100

[1]

t_pd

propagation delay nA, nB to nY; see Figure 6

V_CC= 4.5 V

V_CC= 5.0 V; C_L= 15 pF

[2]

[3]

t_t

transition time

power dissipation per package;

capacitance V_I= GND to V_CC 1.5 V

V_CC= 4.5 V; see Figure 6

C_PD

[1] t_pdis the same as t_PHLand t_PLH

[2] t_tis the same as t_THLand t_TLH

[3] C_PDis used to determine the dynamic power dissipation (P_Din W):

P_D= C_PD V_CC² f_i N +  (C_L V_CC² f_o) where:

f_i= input frequency in MHz;

f_o= output frequency in MHz;

C_L= output load capacitance in pF;

V_CC= supply voltage in V;

N = number of inputs switching;

 (C_L V_CC² f_o) = sum of outputs.

11. Waveforms

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Measurement points are given in Table 9.

V_OLand V_OHare typical output voltage levels that occur with the output load.

Fig 6. Input to output propagation delays

Table 8.

Type

Measurement points

Input

V_M

Output

V_M

V_X

V_Y

74HC32-Q100

74HCT32-Q100

0.5V_CC

1.3 V

0.5V_CC

1.3 V

0.1V_CC

0.9V_CC

74HC_HCT32_Q100

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Product data sheet

Rev. 1 — 1 August 2012

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