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74HC259DB,112

更新时间： 2024-01-25 15:06:15

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恩智浦 - NXP		光电二极管逻辑集成电路触发器
页数	文件大小	规格书
22页	160K
描述
74HC(T)259 - 8-bit addressable latch SSOP1 16-Pin

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74HC259DB,112 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
零件包装代码：	SSOP1	包装说明：	5.30 MM, PLASTIC, MO-150, SOT-338-1, SSOP-16
针数：	16	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.2
其他特性：	1:8 DMUX FOLLOWED BY LATCH	系列：	HC/UH
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e4
长度：	6.2 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	D LATCH	最大I（ol）：	0.004 A
湿度敏感等级：	1	位数：	1
功能数量：	1	端子数量：	16
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装等效代码：	SSOP16,.3
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	2/6 V
Prop。Delay @ Nom-Sup：	56 ns	传播延迟（tpd）：	255 ns
认证状态：	Not Qualified	座面最大高度：	2 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	NICKEL PALLADIUM GOLD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
触发器类型：	LOW LEVEL	宽度：	5.3 mm
Base Number Matches：	1

74HC259DB,112 数据手册

74HC259; 74HCT259

8-bit addressable latch

Rev. 5 — 7 August 2012

Product data sheet

1. General description

The 74HC259; 74HCT259 are high-speed Si-gate CMOS devices and are pin compatible

with Low-power Schottky TTL (LSTTL). They are specified in compliance with JEDEC

standard No. 7-A.

The 74HC259; 74HCT259 are high-speed 8-bit addressable latches designed for

general-purpose storage applications in digital systems. They are multifunctional devices

capable of storing single-line data in eight addressable latches. They provide a 3-to-8

decoder and multiplexer function with active HIGH outputs (Q0 to Q7). They also

incorporate an active LOW common reset (MR) for resetting all latches as well as an

active LOW enable input (LE).

The 74HC259; 74HCT259 has four modes of operation:

• Addressable latch mode, in this mode data on the data line (D) is written into the

addressed latch. The addressed latch follows the data input with all non-addressed

latches remaining in their previous states.

• Memory mode, in this mode all latches remain in their previous states and are

unaffected by the data or address inputs.

• Demultiplexing mode (or 3-to-8 decoding), in this mode the addressed output follows

the state of the data input (D) with all other outputs in the LOW state.

• Reset mode, in this mode all outputs are LOW and unaffected by the address inputs

(A0 to A2) and data input (D).

When operating the 74HC259; 74HCT259 as an address latch, changing more than one

address bit could impose a transient wrong address. Therefore, this should only be done

while in the Memory mode.

2. Features and benefits

 Combined demultiplexer and 8-bit latch

 Serial-to-parallel capability

 Output from each storage bit available

 Random (addressable) data entry

 Easily expandable

 Common reset input

 Useful as a 3-to-8 active HIGH decoder

 Input levels:

 For 74HC259: CMOS level

 For 74HCT259: TTL level

12 3 4 5 6 7...22

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型号	品牌	描述	获取价格	数据表
74HC259DB,118	NXP	74HC(T)259 - 8-bit addressable latch SSOP1 16-Pin	获取价格
74HC259DB-T	NXP	IC HC/UH SERIES, LOW LEVEL TRIGGERED D LATCH, TRUE OUTPUT, PDSO16, 5.30 MM, PLASTIC, MO-15	获取价格
74HC259D-Q100	NXP	8-bit addressable latch	获取价格
74HC259D-Q100	NEXPERIA	8-bit addressable latchProduction	获取价格
74HC259D-T	NXP	IC HC/UH SERIES, LOW LEVEL TRIGGERED D LATCH, TRUE OUTPUT, PDSO16, 3.90 MM, PLASTIC, MS-01	获取价格
74HC259N	NXP	8-bit addressable latch	获取价格

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