74F114SCX

更新时间： 2024-11-04 23:24:07

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飞兆/仙童 - FAIRCHILD		触发器逻辑集成电路光电二极管输入元件
页数	文件大小	规格书
6页	58K
描述
J-K-Type Flip-Flop

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74F114SCX 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	SOIC	包装说明：	SOP, SOP14,.25
针数：	14	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.55
其他特性：	WITH INDIVIDUAL SET INPUTS	系列：	F/FAST
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e0
长度：	8.65 mm	逻辑集成电路类型：	J-K FLIP-FLOP
最大频率@ Nom-Sup：	70000000 Hz	最大I（ol）：	0.02 A
位数：	2	功能数量：	1
端子数量：	14	最高工作温度：	70 °C
最低工作温度：		输出极性：	COMPLEMENTARY
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP14,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	包装方法：	TAPE AND REEL
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	5 V
最大电源电流（ICC）：	19 mA	传播延迟（tpd）：	8.5 ns
认证状态：	Not Qualified	座面最大高度：	1.75 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	TTL
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
触发器类型：	NEGATIVE EDGE	宽度：	3.9 mm
最小 fmax：	95 MHz

74F114SCX 数据手册

April 1988

Revised August 1999

74F114

Dual JK Negative Edge-Triggered Flip-Flop

with Common Clocks and Clears

Simultaneous LOW signals on S_Dand C_Dforce both Q and

Q HIGH.

General Description

The 74F114 contains two high-speed JK flip-flops with

common Clock and Clear inputs. Synchronous state

changes are initiated by the falling edge of the clock. Trig-

gering occurs at a voltage level of the clock and is not

directly related to the transition time. The J and K inputs

can change when the clock is in either state without affect-

ing the flip-flop, provided that they are in the desired state

during the recommended setup and hold times relative to

the falling edge of the clock. A LOW signal on S_Dor C_D

Asynchronous Inputs:

LOW input to S_Dsets Q to HIGH level

LOW input to C_Dsets Q to LOW level

Clear and Set are independent of Clock

Simultaneous LOW on C_Dand S_D

makes both Q and Q HIGH

prevents clocking and forces Q or Q HIGH, respectively.

Ordering Code:

Order Number Package Number

Package Description

74F114SC

74F114PC

M14A

N14A

14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-120, 0.150 Narrow

14-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.

Logic Symbols

Connection Diagram

IEEE/IEC

DS009474

www.fairchildsemi.com

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74F114SCX 替代型号

型号	品牌	替代类型	描述	数据表
74F114PC	FAIRCHILD	功能相似	Dual JK Negative Edge-Triggered Flip-Flop with Common Clocks and Clears

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74F114SPC	FAIRCHILD	获取价格	J-K Flip-Flop, F/FAST Series, 1-Func, Negative Edge Triggered, 2-Bit, Complementary Output
74F114SPCQR	FAIRCHILD	获取价格	J-K Flip-Flop, F/FAST Series, 1-Func, Negative Edge Triggered, 2-Bit, Complementary Output
74F11D	YAGEO	获取价格	AND Gate, F/FAST Series, 3-Func, 3-Input, TTL, PDSO14
74F11DC	FAIRCHILD	获取价格	AND Gate, F/FAST Series, 3-Func, 3-Input, TTL, CDIP14, CERAMIC, DIP-14
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