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74AC11593NT

更新时间： 2024-11-11 20:55:23
品牌 Logo 应用领域
罗彻斯特 - ROCHESTER 输入元件光电二极管输出元件逻辑集成电路触发器
页数 文件大小 规格书
11页 171K
描述
Binary Counter, AC Series, Asynchronous, Positive Edge Triggered, 8-Bit, Up Direction, CMOS, PDIP24, 0.300 INCH, PLASTIC, DIP-24

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74AC11593NT 技术参数

生命周期：Contact Manufacturer包装说明：DIP,
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.76其他特性：TCO OUTPUT; REGISTERED INPUTS; MULTIPLEXED I/O; CENTER VCC/GND PINS
计数方向：UP系列：AC
JESD-30 代码：R-PDIP-T24长度：31.64 mm
负载/预设输入：YES逻辑集成电路类型：BINARY COUNTER
工作模式：ASYNCHRONOUS位数：8
功能数量：1端子数量：24
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE传播延迟（tpd）：14.2 ns
座面最大高度：5.08 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：INDUSTRIAL端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
触发器类型：POSITIVE EDGE宽度：7.62 mm
最小 fmax：70 MHzBase Number Matches：1

74AC11593NT 数据手册

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SCAS202 − MARCH 1992 − REVISED APRIL 1993  
DW OR NT PACKAGE  
(TOP VIEW)  
• Parallel 3-State I/O: Register Inputs/  
Counter Outputs  
• Counter Has Direct Overriding Load and  
A/Q  
B/Q  
C/Q  
CCK  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
A
B
Clear  
CCLR  
2
• Flow-Through Architecture Optimizes  
CCKEN  
CCKEN  
CLOAD  
3
C
PCB Layout  
D/Q  
4
D
• Center-Pin V  
and GND Configurations  
Minimize High-Speed Switching Noise  
GND  
GND  
GND  
GND  
5
CC  
6
V
V
CC  
CC  
7
• EPICt (Enhanced-Performance Implanted  
8
OE  
CMOS) 1-mm Process  
9
E/Q  
OE  
E
• 500-mA Typical Latch-Up Immunity  
at 125°C  
• Package Options Include Plastic  
Small-Outline Packages and Standard  
Plastic 300-mil DIPs  
10  
11  
12  
F/Q  
RCK  
RCK  
RCO  
F
G/Q  
G
H/Q  
H
description  
The 74AC11953 consists of a parallel input, an 8-bit storage register feeding an 8-bit counter, and a 3-state I/O  
which provides parallel count outputs. Both the register and the counter have individual positive-edge triggered  
clocks.  
The function tables show the operation of the counter clock-enable (CCKEN, CCKEN) and output-enable (OE,  
OE) inputs. A register clock-enable (RCK) input is also provided.  
The counter (RCO) input has direct load and clear functions. A low-going RCO pulse will be obtained when the  
counter reaches the hex word FF. Expansion is easily accomplished for two stages by connecting RCO of the  
first stage to CCKEN of the second stage. Cascading for larger count chains can be accomplished by  
connecting RCO of each stage to CCK of the following stage.  
The 74AC11593 is characterized for operation from − 40°C to 85°C.  
Function Tables  
COUNTER CLOCK ENABLE  
INPUTS  
OUTPUT ENABLE  
INPUTS  
OUTPUTS  
OUTPUTS  
A/Q THRU H/Q  
A
A/Q THRU H/Q  
A H  
CCKEN  
CCKEN  
H
OE  
OE  
L
L
H
H
L
H
L
Enable  
Disable  
Enable  
Enable  
L
L
H
H
L
H
L
Input mode  
Input mode  
Output mode  
Input mode  
H
H
EPIC is a trademark of Texas Instruments Incorporated.  
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Copyright 1993, Texas Instruments Incorporated  
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2−1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77001  
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型号 品牌 获取价格 描述 数据表
74AC11620 NXP

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 		OCTAL TRANSCEIVER WITH DUAL ENABLE
74AC11620D NXP

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74AC11620D YAGEO

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