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74ABT821D,623

更新时间： 2024-02-25 16:23:10
品牌 Logo 应用领域
恩智浦 - NXP 驱动信息通信管理光电二极管输出元件逻辑集成电路触发器
页数 文件大小 规格书
17页 97K
描述
74ABT821 - 10-bit D-type flip-flop; positive-edge trigger; 3-state SOP 24-Pin

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74ABT821D,623 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SOP包装说明：SOP, SOP24,.4
针数：24Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.38
其他特性：POWER OFF DISABLE OUTPUTS TO PERMIT LIVE INSERTION; WITH POWER-UP RESET系列：ABT
JESD-30 代码：R-PDSO-G24JESD-609代码：e4
长度：15.4 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS DRIVER最大频率@ Nom-Sup：125000000 Hz
最大I（ol）：0.064 A湿度敏感等级：1
位数：10功能数量：1
端口数量：2端子数量：24
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP24,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：5 V
最大电源电流（ICC）：38 mA传播延迟（tpd）：6.7 ns
认证状态：Not Qualified座面最大高度：2.65 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：BICMOS
温度等级：INDUSTRIAL端子面层：NICKEL/PALLADIUM/GOLD (NI/PD/AU)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
触发器类型：POSITIVE EDGE宽度：7.5 mm
Base Number Matches：1

74ABT821D,623 数据手册

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74ABT821  
Philips Semiconductors  
10-bit D-type flip-flop; positive-edge trigger; 3-state  
Table 7:  
Static characteristics …continued  
At recommended operating conditions; voltages are referenced to GND (ground = 0 V).  
Symbol Parameter  
Conditions  
Min  
Typ  
Max Unit  
IOZ  
3-state output current  
VCC = 5.5 V; VI = VIL or VIH  
output HIGH-state at VO = 2.7 V  
output LOW-state at VO = 0.5 V  
VCC = 5.5 V; VO = 5.5 V; VI = GND or VCC  
-
-
-
-
-
-
50  
µA  
µA  
µA  
−50  
50  
ICEX  
output HIGH-state leakage  
current  
[3]  
IO  
output current  
VCC = 5.5 V; VO = 2.5 V  
VCC = 5.5 V; VI = GND or VCC  
outputs HIGH-state  
−50  
-
−180 mA  
ICC  
quiescent supply current  
-
-
-
-
-
-
-
-
250  
38  
µA  
outputs LOW-state  
mA  
µA  
outputs 3-state  
250  
1.5  
[4]  
∆ICC  
additional supply current per VCC = 5.5 V; one input at 3.4 V and other  
input pin inputs at VCC or GND  
mA  
[1] For valid test results, data must not be loaded into the flip-flops (or latches) after applying the power.  
[2] This parameter is valid for any VCC between 0 V and 2.1 V with a transition time of up to 10 ms. For VCC = 2.1 V to VCC = 5 V ± 10 %, a  
transition time of up to 100 µs is permitted.  
[3] Not more than one output should be tested at a time, and the duration of the test should not exceed one second.  
[4] This is the increase in supply current for each input at 3.4 V.  
11. Dynamic characteristics  
Table 8:  
Dynamic characteristics  
GND = 0 V; for test circuit see Figure 8.  
Symbol Parameter  
Conditions  
Min  
Typ  
Max Unit  
Tamb = 25 °C; VCC = 5.0 V  
tPLH  
tPHL  
tPZH  
tPZL  
tPHZ  
tPLZ  
tsu(H)  
tsu(L)  
th(H)  
th(L)  
tWH  
propagation delay CP to Qn  
propagation delay CP to Qn  
output enable time to HIGH-level  
output enable time to LOW-level  
output disable time from HIGH-level  
output disable time from LOW-level  
set-up time HIGH Dn to CP  
set-up time LOW Dn to CP  
hold time HIGH Dn to CP  
see Figure 5  
see Figure 5  
see Figure 7  
see Figure 7  
see Figure 7  
see Figure 7  
see Figure 6  
see Figure 6  
see Figure 6  
see Figure 6  
see Figure 5  
see Figure 5  
see Figure 5  
2.1  
2.8  
1.0  
2.2  
2.7  
2.3  
2.1  
2.1  
1.3  
4.1  
4.6  
3.0  
4.1  
4.7  
4.6  
0.5  
0.3  
0.0  
5.6  
6.2  
4.5  
5.6  
6.2  
6.1  
-
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
-
-
hold time LOW Dn to CP  
+1.3 −0.3  
-
pulse width HIGH of CP  
2.9  
3.8  
125  
1.8  
2.8  
185  
-
tWL  
pulse width LOW of CP  
-
fmax  
maximum clock frequency  
-
Tamb = −40 °C to +85 °C; VCC = 5.0 V ± 0.5 V  
tPLH  
tPHL  
tPZH  
propagation delay CP to Qn  
propagation delay CP to Qn  
output enable time to HIGH-level  
see Figure 5  
see Figure 5  
see Figure 7  
2.1  
2.8  
1.0  
-
-
-
6.2  
6.7  
5.3  
ns  
ns  
ns  
9397 750 14867  
© Koninklijke Philips Electronics N.V. 2005. All rights reserved.  
Product data sheet  
Rev. 02 — 12 April 2005  
7 of 17  
 
 
 
 
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