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73K224L-28IHR/F

更新时间： 2024-01-13 05:34:06

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TERIDIAN		调制解调器电信集成电路电信电路
页数	文件大小	规格书
31页	243K
描述
Single-Chip Modem

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73K224L-28IHR/F 技术参数

生命周期：	Obsolete	包装说明：	LEAD FREE, PLASTIC, LCC-28
Reach Compliance Code：	unknown	风险等级：	5.58
数据速率：	2.4 Mbps	JESD-30 代码：	S-PQCC-J28
长度：	11.54 mm	功能数量：	1
端子数量：	28	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	QCCJ	封装形状：	SQUARE
封装形式：	CHIP CARRIER	认证状态：	Not Qualified
座面最大高度：	4.191 mm	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
电信集成电路类型：	MODEM	温度等级：	INDUSTRIAL
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	宽度：	11.54 mm
Base Number Matches：	1

73K224L-28IHR/F 数据手册

73K224L

V.22bis, V.22, V.21, Bell 212A, 103

Single-Chip Modem

DATA SHEET

CONTROL REGISTER 0

CR0

000

MODUL. MODUL.

OPTION

MODUL.

TYPE 0

TRANSMIT

MODE 2

TRANSMIT

MODE 1

TRANSMIT

MODE 0

TRANSMIT

ENABLE

ANSWER/

ORIGINATE

TYPE 1

BIT NO.

NAME

CONDITION

DESCRIPTION

Answer/

Originate

Selects answer mode (transmit in high band, receive in low

band).

Selects originate mode (transmit in low band, receive in

high band).

Transmit

Enable

Disables transmit output at TXA.

Enables transmit output at TXA.

Note: Transmit Enable must be set to 1 to allow activation

of Answer Tone or DTMF.

D5 D4 D3 D2

Selects power down mode. All functions disabled except

digital interface.

Internal synchronous mode. In this mode TXCLK is an

internally derived 600,1200 or 2400 Hz signal. Serial input

data appearing at TXD must be valid on the rising edge of

TXCLK. Receive data is clocked out of RXD on the falling

edge of RXCLK.

D5, D4,

D3, D2

Transmit

Mode

External synchronous mode. Operation is identical to

internal synchronous, but TXCLK is connected internally to

EXCLK pin, and a 600, 1200 or 2400 Hz clock must be

supplied externally.

Slave synchronous mode. Same operation as other

synchronous modes. TXCLK is connected internally to the

RXCLK pin in this mode.

Selects asynchronous mode - 8 bits/character (1 start bit, 6

data bits, 1 stop bit).

Selects asynchronous mode - 9 bits/character (1 start bit, 7

data bits, 1 stop bit).

Selects asynchronous mode - 10 bits/character (1 start bit,

8 data bits, 1 stop bit).

Selects asynchronous mode - 11 bits/character (1 start bit,

8 data bits, Parity and/or 1 or 2 stop bits).

Selects FSK operation.

D6 D5

D6,D5

Modulation

Type

QAM

DPSK

FSK

Page: 8 of 31

Rev 7.1

1...5 6 789 10 11...31

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