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71V546XS133PFG

更新时间: 2024-02-01 14:46:14
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艾迪悌 - IDT 时钟静态存储器内存集成电路
页数 文件大小 规格书
21页 164K
描述
3.3V Synchronous SRAM

71V546XS133PFG 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Active包装说明:QFP, QFP100,.63X.87
Reach Compliance Code:compliantECCN代码:3A991.B.2.A
HTS代码:8542.32.00.41风险等级:5.21
最长访问时间:4.2 ns最大时钟频率 (fCLK):133 MHz
I/O 类型:COMMONJESD-30 代码:R-PQFP-G100
JESD-609代码:e3内存密度:4718592 bit
内存集成电路类型:ZBT SRAM内存宽度:36
湿度敏感等级:3功能数量:1
端子数量:100字数:131072 words
字数代码:128000工作模式:SYNCHRONOUS
最高工作温度:70 °C最低工作温度:
组织:128KX36输出特性:3-STATE
封装主体材料:PLASTIC/EPOXY封装代码:QFP
封装等效代码:QFP100,.63X.87封装形状:RECTANGULAR
封装形式:FLATPACK并行/串行:PARALLEL
峰值回流温度(摄氏度):260电源:3.3 V
认证状态:Not Qualified最大待机电流:0.04 A
最小待机电流:3.14 V子类别:SRAMs
最大压摆率:0.3 mA最大供电电压 (Vsup):3.465 V
最小供电电压 (Vsup):3.135 V标称供电电压 (Vsup):3.3 V
表面贴装:YES技术:CMOS
温度等级:COMMERCIAL端子面层:Matte Tin (Sn) - annealed
端子形式:GULL WING端子节距:0.635 mm
端子位置:QUAD处于峰值回流温度下的最长时间:30
Base Number Matches:1

71V546XS133PFG 数据手册

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IDT71V546, 128K x 36, 3.3V Synchronous SRAM with  
ZBTFeature, Burst Counter and Pipelined Outputs  
Commercial and Industrial Temperature Ranges  
Pin Configuration — 128K X 36  
100 99 98 97 96 95 94 93 92 91 90 89 88 87 86 85 84 83 82 81  
1
80  
I/OP3  
I/O16  
I/O17  
I/OP2  
I/O15  
I/O14  
2
79  
.
3
78  
4
77  
V
DD  
V
DD  
5
V
SS  
76  
75  
74  
73  
VSS  
6
I/O18  
I/O19  
I/O20  
I/O21  
I/O13  
I/O12  
I/O11  
I/O10  
7
8
9
72  
71  
10  
11  
12  
13  
14  
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18  
19  
20  
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23  
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25  
26  
27  
28  
29  
30  
V
SS  
V
V
SS  
70  
69  
68  
67  
66  
65  
64  
V
DD  
DD  
I/O22  
I/O  
I/O  
9
8
I/O23  
(1)  
V
DD  
V
SS  
V
V
V
DD  
DD  
SS  
VDD  
PK100-1  
VDD  
VSS  
63  
62  
I/O24  
I/O25  
I/O7  
I/O6  
61  
60  
59  
V
DD  
V
V
DD  
SS  
V
SS  
I/O26  
I/O27  
I/O28  
I/O29  
I/O  
I/O  
I/O  
I/O  
5
4
3
2
58  
57  
56  
55  
V
SS  
V
V
SS  
54  
53  
52  
51  
V
DD  
DD  
I/O30  
I/O31  
I/OP4  
I/O  
I/O  
1
0
.
I/OP1  
31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50  
3821 drw 02  
100 TQFP  
Top View  
NOTES:  
1. Pin 14 does not have to be connected directly to VDD as long as the input voltage is > VIH.  
2. Pins 83 and 84 are reserved for future A17 (8M) and A18 (16M) respectively.  
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