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7132LA20JG8

更新时间： 2024-09-29 15:26:23
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艾迪悌 - IDT 静态存储器内存集成电路
页数 文件大小 规格书
17页 269K
描述
PLCC-52, Reel

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7132LA20JG8 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：PLCC
包装说明：QCCJ, LDCC52,.8SQ针数：52
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.32.00.41风险等级：5.14
最长访问时间：20 ns其他特性：AUTOMATIC POWER DOWN
I/O 类型：COMMONJESD-30 代码：S-PQCC-J52
JESD-609代码：e3长度：19.1262 mm
内存密度：16384 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：8湿度敏感等级：1
功能数量：1端口数量：2
端子数量：52字数：2048 words
字数代码：2000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：2KX8输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC52,.8SQ封装形状：SQUARE
封装形式：CHIP CARRIER并行/串行：PARALLEL
峰值回流温度（摄氏度）：260电源：5 V
认证状态：Not Qualified座面最大高度：4.572 mm
最大待机电流：0.0015 A最小待机电流：2 V
子类别：SRAMs最大压摆率：0.2 mA
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn) - annealed端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：19.1262 mm
Base Number Matches：1

7132LA20JG8 数据手册

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HIGH SPEED  
2K x 8 DUAL PORT  
STATIC RAM  
IDT7132SA/LA  
IDT7142SA/LA  
LEAD FINISH (SnPb) ARE IN EOL PROCESS - LAST TIME BUY EXPIRES JUNE 15, 2018  
◆
MASTERIDT7132easilyexpandsdatabuswidthto16-or-more  
bits using SLAVE IDT7142  
Features  
◆
High-speed access  
◆
◆
◆
◆
◆
On-chip port arbitration logic (IDT7132 only)  
BUSY output flag on IDT7132; BUSY input on IDT7142  
Battery backup operation —2V data retention (LA only)  
TTL-compatible, single 5V ±10% power supply  
Available in 48-pin DIP, LCC and Flatpack, and 52-pin PLCC  
packages  
Military product compliant to MIL-PRF-38535 QML  
Industrial temperature range (–40°C to +85°C) is available for  
selected speeds  
– Commercial:20/25/35/55/100ns(max.)  
– Industrial: 25ns (max.)  
– Military:25/35/55/100ns(max.)  
Low-power operation  
◆
–
IDT7132/42SA  
Active: 325mW (typ.)  
Standby: 5mW (typ.)  
– IDT7132/42LA  
Active:325mW(typ.)  
Standby: 1mW (typ.)  
◆
◆
◆
Green parts available, see ordering information  
Functional Block Diagram  
OE  
R
OE  
CE  
R/W  
L
L
CER  
L
R/W  
R
I/OOL-I/O7L  
I/OOR-I/O7R  
I/O  
Control  
I/O  
Control  
m
(1,2)  
(1,2)  
BUSY  
L
BUSY  
R
A
10L  
A
10R  
0R  
Address  
Decoder  
MEMORY  
ARRAY  
Address  
Decoder  
A
0L  
A
11  
11  
ARBITRATION  
LOGIC  
CE  
OE  
R/W  
R
R
CE  
OE  
R/W  
L
L
L
R
2692 drw 01  
NOTES:  
1. IDT7132 (MASTER): BUSY is open drain output and requires pullup resistor of 270Ω.  
IDT7142 (SLAVE): BUSY is input.  
2. Open drain output: requires pullup resistor of 270Ω.  
JULY 2018  
1
DSC-2692/22  
1234567...17

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7132LA20JG8 替代型号

型号 品牌 替代类型 描述 数据表
7132LA20JG IDT

完全替代

 PLCC-52, Tube
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完全替代

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