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5V9885TNLGI8

更新时间： 2024-01-26 04:11:06

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3.3V EEPROM PROGRAMMABLE CLOCK GENERATOR

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5V9885TNLGI8 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	VFQFPN
包装说明：	QCCN, LCC28,.24SQ,25	针数：	28
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.29
Samacsys Confidence：	3	Samacsys Status：	Released
2D Presentation：	https://componentsearchengine.com/2D/0T/730035.2.1.png	Schematic Symbol：	https://componentsearchengine.com/symbol.php?partID=730035
PCB Footprint：	https://componentsearchengine.com/footprint.php?partID=730035	3D View：	https://componentsearchengine.com/viewer/3D.php?partID=730035
Samacsys PartID：	730035	Samacsys Image：	https://componentsearchengine.com/Images/9/5V9885TNLGI8.jpg
Samacsys Thumbnail Image：	https://componentsearchengine.com/Thumbnails/2/5V9885TNLGI8.jpg	Samacsys Pin Count：	29
Samacsys Part Category：	Integrated Circuit	Samacsys Package Category：	Quad Flat No-Lead
Samacsys Footprint Name：	nlg28	Samacsys Released Date：	2020-01-16 10:43:20
Is Samacsys：	N	JESD-30 代码：	S-XQCC-N28
JESD-609代码：	e3	长度：	6.3 mm
湿度敏感等级：	1	端子数量：	28
最高工作温度：	85 °C	最低工作温度：	-40 °C
最大输出时钟频率：	500 MHz	封装主体材料：	UNSPECIFIED
封装代码：	QCCN	封装等效代码：	LCC28,.24SQ,25
封装形状：	SQUARE	封装形式：	CHIP CARRIER
峰值回流温度（摄氏度）：	260	电源：	3.3 V
主时钟/晶体标称频率：	400 MHz	认证状态：	Not Qualified
子类别：	Clock Generators	最大压摆率：	110 mA
最大供电电压：	3.6 V	最小供电电压：	3 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn) - annealed	端子形式：	NO LEAD
端子节距：	0.65 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	6.3 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

5V9885TNLGI8 数据手册

IDT5V9885T

3.3V EEPROMPROGRAMMABLECLOCKGENERATOR

INDUSTRIALTEMPERATURERANGE

FUNCTIONALBLOCKDIAGRAM

XTALOUT

OSC.

XTALIN/REFIN

OUT1

P2 Divider

10-Bit

OUT2

P3 Divider

10-Bit

PLL 0

OUT3

CLKIN

OUT4⁽¹⁾

P4 Divider

10-Bit

PLL 1

PLL 2

(1)

OUT4

OUT5⁽¹⁾

OUT5 ⁽¹⁾

P5 Divider

10-Bit

SHUTDOWN/OE

P6 Divider

10-Bit

EEPROM

OUT6

GOUT0/TDO/

LOSS_LOCK

GIN5/CLK_SEL

I ²C/JTAG

Control Block for

Multi-Purpose I/O, Programming, Features

GOUT1/

LOSS_CLKIN

NOTE:

1. OUT4 and OUT5 pairs can be configured to be LVDS, LVPECL, or two single-ended LVTTL outputs. As LVTTL, OUT4 and OUT5 can be configured to be non-inverting.

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